pcie 4.0 phy ip 文章 最新資訊
閃迪PCIe Gen 5企業(yè)級固態(tài)硬盤榮獲開放計算組織OCP Inspired?認證
- Sandisk閃迪近日宣布，其PCIe? Gen 5 SANDISK? SN861 NVMe SSD已獲得開放計算組織（Open Compute Project，OCP）的OCP Inspired?認證。這一認證意味著SANDISK? SN861 NVMe SSD在OCP協(xié)會的評審中展現(xiàn)出卓越的產(chǎn)品效率、影響力、開放性、可擴展性和可持續(xù)性，符合數(shù)據(jù)中心NVMe SSD規(guī)范。目前，SANDISK? SN861 NVMe SSD已正式上線OCP Marketplace平臺。
- 關鍵字： 閃迪 PCIe Gen 5 企業(yè)級固態(tài)硬盤 OCP
Microchip推出首款3納米PCIe Gen 6交換機，賦能現(xiàn)代AI基礎設施
- 隨著人工智能（AI）工作負載和高性能計算（HPC）應用對數(shù)據(jù)傳輸速度與低延遲的需求持續(xù)激增，Microchip Technology Inc.（微芯科技公司）宣布推出下一代Switchtec? Gen 6 PCIe? 交換機。作為業(yè)界首款采用3納米制程工藝的PCIe Gen 6交換機，Switchtec Gen 6系列旨在實現(xiàn)更低功耗，并支持最多160通道，滿足高密度AI系統(tǒng)的連接需求。該系列交換機的高級安全功能包括基于硬件的信任根、安全啟動功能，并采用符合美國商用國家安全算法規(guī)范2.0（CNSA 2.0
- 關鍵字： Microchip PCIe Gen 6 交換機
為什么選擇 PCIe 5.0 來滿足邊緣的功耗、性能和帶寬？
- 關鍵PCIe 5.0 仍然是當今大多數(shù)應用的實用選擇，允許從 PCIe 4.0 遷移，并且僅在絕對必要時遷移到 PCIe 6.0。邊緣人工智能正在推動技術的重大變革，預計到 2027-2028 年，50% 的數(shù)據(jù)中心容量將由人工智能驅動，這使得 PCIe 5.0 的高帶寬和低延遲至關重要。PCIe 5.0 為各種應用提供了靈活性，平衡了功耗、性能、面積和延遲權衡，這對于汽車和高性能計算等行業(yè)至關重要。低功耗設計技術對于邊緣設備和節(jié)能系統(tǒng)都至關重要，PCIe 5.0 支持各種電源狀態(tài)，以減少能耗，同時保持性
- 關鍵字： PCIe 5.0 功耗 性能 帶寬
用于改進設計驗證的斷言 IP （AIP）
- 多年來，設計重用方法為半導體 IP （SIP） 創(chuàng)造了一個市場，現(xiàn)在有了正式的技術，就需要斷言 IP （AIP）。其中，每個AIP都是硬件設計中用于檢測被測設計（DUT）中的協(xié)議和功能違規(guī)的可重用和可配置驗證組件。LUBIS EDA 專注于正式服務和工具，因此我收到了有關他們開發(fā)這些 AIP 和檢測高風險 IP 中極端情況錯誤的方法的最新信息。在詳細介紹 LUBIS EDA 使用的方法之前，讓我們先回顧一下基于仿真的驗證與形式驗證有何不同。通過仿真，工程師正在編寫激勵來覆蓋設計的所有已知狀態(tài)，希望覆蓋范圍
- 關鍵字： 設計驗證 斷言 IP AIP
應對團體設計項目的挑戰(zhàn)
- 世界各地的政府和行業(yè)齊心協(xié)力解決大規(guī)模芯片設計挑戰(zhàn)。美國國防部的微電子中心 （ME Commons）、歐盟芯片法案試點線和日本政府支持的 Rapidus 財團等團體通常由老牌公司、研究機構、學術界和初創(chuàng)公司組成——每個機構都帶來了不同的技能。是德科技設計與驗證業(yè)務部總經(jīng)理 Nilesh Kamdar 表示，在這種情況下，芯片設計界正在加速、擴大規(guī)模，并承擔如果沒有政府資助，他們可能不會承擔的風險，是德科技參與了國防部的許多 ME Commons，最近與 Rapidus 合作開發(fā)了高精度工藝設計套
- 關鍵字： 團體設計項目 IP 是德科技
無縫升級嵌入式芯片AI能力！安謀科技Arm China推出新一代CPU IP“星辰”STAR-MC3
- 國內(nèi)領先的芯片IP設計與服務提供商安謀科技（中國）有限公司（以下簡稱“安謀科技”）今日宣布，正式推出自主研發(fā)的第三代高能效嵌入式芯片IP——“星辰”STAR-MC3。該產(chǎn)品基于Arm?v8.1-M架構，向前兼容傳統(tǒng)MCU架構，集成Arm Helium?技術，顯著提升CPU在AI計算方面的性能，同時兼具優(yōu)異的面效比與能效比，實現(xiàn)高性能與低功耗設計，面向AIoT智能物聯(lián)網(wǎng)領域，為主控芯片及協(xié)處理器提供核芯架構，助力客戶高效部署端側AI應用。STAR-MC3處理器概覽STAR-MC3五大技術亮點1.更強的AI能
- 關鍵字： 安謀科技 Arm China CPU IP 嵌入式芯片
SiFive推出全新RISC-V IP，融合標量、向量與矩陣運算
- SiFive 近日正式推出第二代 Intelligence? 系列，進一步強化其在 RISC-V AI IP 領域的技術領先優(yōu)勢。此次發(fā)布的五款新產(chǎn)品，專為加速數(shù)千種 AI 應用場景中的工作負載而設計。該系列包括兩款全新產(chǎn)品——X160 Gen 2 與 X180 Gen 2，以及升級版 X280 Gen 2、X390 Gen 2 和 XM Gen 2。所有新產(chǎn)品均具備增強的標量、向量處理能力，其中 XM 產(chǎn)品還加入了矩陣處理功能，專為現(xiàn)代AI工作負載設計。其中，X160 Gen 2 與 X180 Gen
- 關鍵字： SiFive RISC-V IP
PCIe Gen6加速落地，泰克攜手安立與瀾起展示完整一致性測試方案
- _____PCIe總線的高吞吐量和低延遲，使得處理器與處理器之間、處理器與外圍芯片之間能更高效地協(xié)同工作，這對于處理大規(guī)模的神經(jīng)網(wǎng)絡和復雜的AI模型至關重要， 是AI蓬勃發(fā)展的關鍵技術底座之一。根據(jù)行業(yè)動態(tài)推測，新一代PCIe規(guī)范 - PCIe Gen6將在2025年下半年開始加速落地。 值此技術迭代的關鍵時期，泰克(Tektronix)和安立(Anritsu)在2025年8月26日于蘇州舉辦的PCIe技術發(fā)展大會上，展出了物理層發(fā)送端&接收端一致性測試的完整解決方案，并對瀾起的PCIe6 Ret
- 關鍵字： PCIe Gen6 泰克 安立 瀾起 一致性測試
燦芯半導體推出PCIe 4.0 PHY IP
- 一站式定制芯片及IP供應商——燦芯半導體（上海）股份有限公司（燦芯股份，688691）宣布推出基于28HKC+ 0.9V/1.8V平臺的PCIe 4.0 PHY IP。該PHY IP符合PCIe 4.0規(guī)范的要求，支持PIPE 4.4.1/5.2接口及2.5Gbps至16Gbps的數(shù)據(jù)傳輸速率，全面覆蓋PCIe Gen4.0/3.0/2.0/1.0標準，并兼容Rapid IO、JESD204B/C、USB3.2/3.1/3.0、10GBASE-R/KR等其他協(xié)議。憑借其優(yōu)越的
- 關鍵字： 燦芯 PCIe 4.0 PHY IP
Ceva無線連接IP市場份額達68%，穩(wěn)居行業(yè)首位
- 據(jù)IPnest最新發(fā)布的2025年設計IP報告顯示，Ceva公司在無線連接IP領域繼續(xù)保持領先地位，市場份額在2024年增長至68%。這一數(shù)字是其最接近競爭對手的10倍以上，進一步鞏固了其在智能邊緣設備聯(lián)機功能中的核心地位。Ceva（納斯達克股票代碼：CEVA）作為全球領先的智能邊緣領域半導體產(chǎn)品和軟件IP授權許可廠商，其技術覆蓋藍牙、Wi-Fi、UWB、802.15.4及蜂窩物聯(lián)網(wǎng)IP解決方案。這些技術為下一代智能邊緣設備提供了重要支持，滿足了市場對高性能、低功耗解決方案的不斷增長需求。Ceva首席運營
- 關鍵字： Ceva 無線連接 IP
Arteris將為AMD新一代AI芯粒設計提供FlexGen智能片上網(wǎng)絡 (NoC) IP
- 在AI計算需求重塑半導體市場的背景下。致力于加速系統(tǒng)級芯片 (SoC) 開發(fā)的領先系統(tǒng) IP 提供商 Arteris 公司近日宣布，高性能與自適應計算領域的全球領導者 AMD（納斯達克股票代碼：AMD）已在其新一代AI 芯粒設計中采用FlexGen片上網(wǎng)絡互連IP。Arteris的這項智能NoC IP技術將為 AMD 芯粒提供高性能數(shù)據(jù)傳輸支持，賦能AMD從數(shù)據(jù)中心到邊緣及終端設備的廣泛產(chǎn)品組合中的AI應用。Arteris FlexGen NoC IP與AMD Infinity Fabric?互連技術的戰(zhàn)
- 關鍵字： Arteris AMD AI芯粒 片上網(wǎng)絡 NoC IP
PCIe M.2接口測試的現(xiàn)狀、挑戰(zhàn)與泰克解決方案
- _____隨著技術的不斷進步，PCIe M.2接口已成為現(xiàn)代電子設備中不可或缺的高速數(shù)據(jù)傳輸解決方案。從固態(tài)硬盤（SSD）到無線網(wǎng)卡，再到各種專用加速卡，M.2接口以其小巧的尺寸和卓越的性能，廣泛應用于輕薄筆記本電腦、迷你PC和高性能臺式機中。然而，隨著PCIe Gen4和Gen5技術的普及，M.2接口的電氣驗證測試面臨著前所未有的挑戰(zhàn)。本文將從行業(yè)角度出發(fā)，探討PCIe M.2接口測試的現(xiàn)狀、挑戰(zhàn)以及泰克提供的創(chuàng)新解決方案。PCIe M.2接口：高性能與小尺寸的完美結合PCIe M.2接口是一種基于PC
- 關鍵字： PCIe M.2 接口測試 泰克
四大核心要素驅動汽車智能化創(chuàng)新與相關芯片競爭格局
- 智能汽車時代的加速到來，使車載智能系統(tǒng)面臨前所未有的算力需求。隨著越來越多車型引入電子電氣架構轉向中心化、智能駕駛的多傳感器融合、智能座艙的多模態(tài)交互以及生成式AI驅動的虛擬助手等創(chuàng)新技術，都要求車用主芯片能夠同時勝任圖形渲染、AI推理和安全計算等多重任務。當下，功能安全、高效高靈活性的算力、產(chǎn)品生命周期，以及軟件生態(tài)兼容性這“四大核心要素”，已成為衡量智能汽車AI芯片創(chuàng)新力和市場競爭力的核心標準。傳統(tǒng)汽車計算架構中，往往采用CPU與GPU或/和NPU等計算單元組成異構計算模式；隨著自動駕駛算法從L1向L
- 關鍵字： 202507 汽車智能化 Imagination GPU IP
合見工軟發(fā)布先進工藝多協(xié)議兼容、集成化傳輸接口SerDes IP解決方案
- 中國數(shù)字EDA/IP龍頭企業(yè)上海合見工業(yè)軟件集團有限公司（簡稱“合見工軟”）近日發(fā)布國產(chǎn)自主研發(fā)支持多協(xié)議的32G SerDes PHY 解決方案UniVista 32G Multi-Protocol SerDes IP (簡稱UniVista 32G MPS IP)。該多協(xié)議PHY產(chǎn)品可支持PCIe5、USB4、以太網(wǎng)、SRIO、JESD204C等多種主流和專用協(xié)議，并支持多家先進工藝，成功應用在高性能計算、人工智能AI、數(shù)據(jù)中心等復雜網(wǎng)絡領域IC企業(yè)芯片中部署。隨著全球數(shù)據(jù)量呈指數(shù)級增長，這場由數(shù)據(jù)驅
- 關鍵字： 合見工軟 SerDes IP
Diodes公司64GT/s PAM4線性ReDriver信號調節(jié)器為PCIe 6.0接口速度加強信號質量
- Diodes 公司近日推出業(yè)界首款可達到 PCI Express? (PCIe?) 6.0 協(xié)議速率 (高達 64GT/s) 并且向下兼容 PCIe 5.0/4.0/3.0 協(xié)議的ReDriver? 信號調節(jié)器。PI3EQX64904 是一款低功耗、高性能 PAM4 線性 ReDriver 信號調節(jié)器，速率可達 64GT/s，具有四個差分通道。目標產(chǎn)品應用包括 AI 數(shù)據(jù)中心 (存儲與服務器)、工作站、5G 網(wǎng)絡、CPU 到網(wǎng)絡 (PCIe NIC 卡) 與 CPU 到存儲 (NVME) 互連，以及高性能
- 關鍵字： Diodes 信號調節(jié)器 PCIe 6.0
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