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          cadence.spb.15.2. 文章 最新資訊

          Cadence推出對應OVM的驗證IP

          •   全球電子設計創(chuàng)新企業(yè)Cadence 設計系統(tǒng)公司(NASDAQ: CDNS)今天宣布推出首批兩款對應開放式驗證方法學(OVM)的高級測試平臺驗證IP(VIP)產品。這些改進能夠讓迅猛發(fā)展的OVM用戶團體輕松獲得Cadence®指標導向型驗證解決方案,可預測地實現(xiàn)高質量驗證閉合。AMBA® 3 AXI ™ 和AMBA AHB™ VIP已經在數百種設計中得以證明,現(xiàn)在作為多語言的通用驗證組件(Universal Verification Components ,UV
          • 關鍵字: Cadence  OVM  驗證IP  VIP  

          Cadence強化的高級節(jié)點設計解決方案對定制IC設計實現(xiàn)經過實際生產驗證的改良

          •   全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(納斯達克: CDNS),今天公布了一系列新的定制IC設計功能,幫助芯片制造商加快大型復雜設計的量產化,尤其是在65納米及以下的高級節(jié)點工藝。這些經過實際生產證明對Virtuoso?技術的提升,進一步強化了Cadence用于降低風險和提升生產力的同時管理幾何尺寸與復雜性的全套解決方案。   對Virtuoso? 定制設計平臺的主要改進將會出現(xiàn)在最新版本中,提供更為緊密的可生產性整合、更好的寄生分析,更快的仿真工具,用于精確而高效地驗證
          • 關鍵字: Cadence  IC  定制數字  模擬/混合信號  系統(tǒng)級芯片設計  Virtuoso  

          Cadence新技術加速模擬和混合信號驗證

          •   全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(納斯達克: CDNS),今天宣布Cadence®Virtuoso® Spectre® Circuit Simulator中的高級“turbo”技術目前已經推出,這是業(yè)界領先的模擬SPICE電路仿真器,獲得了全面的晶圓廠支持。這種turbo技術能夠在提升性能的同時,確保硅片的精確性,讓設計師能夠驗證他們復雜的大型模擬設計,例如PLL(phase-locked loops)、ADC(analog-to-di
          • 關鍵字: Cadence  turbo  Cadence?Virtuoso? Spectre? Circuit Simulator  

          Cadence聯(lián)手香港科技園

          • 中國香港,2008年2月19日——全球電子設計創(chuàng)新領導廠商Cadence設計系統(tǒng)公司(納斯達克: CDNS)今天宣布香港科技園公司(香港科技園)已經選擇Cadence為其通信、無線、移動和多媒體產業(yè)的客戶提供更先進的EDA技術和解決方案。通過與Cadence的合作,香港科技園幫助香港政府為眾多中小型IC企業(yè)提供支持。此外,該合作關系再次確認了Cadence做為EDA供應商在香港的領先地位。 “通過我們與全球領先的EDA供應商Cadence的合作,香港IC設計平臺已
          • 關鍵字: Cadence 香港科技園  

          CADENCE硬件仿真器在Ethernet交換芯片驗證中的應用

          •   隨著網絡通信的高速發(fā)展,集成多種內容的以太網交換芯片在網絡通信中起著越來越重要的作用,如何加快以太網交換芯片的開發(fā)速度,縮短驗證的周期,是我們面臨的重要課題,為此,我們選用了CADENCE硬件仿真器Palladium作為驗證加速平臺。   1 概述   隨著網絡通信的高速發(fā)展,集成多種內容的以太網交換芯片在網絡通信中起著越來越重要的作用,如何加快以太網交換芯片的開發(fā)速度,縮短驗證的周期,是我們面臨的重要課題,為此,我們選用了Cadence硬件仿真器Palladium作為驗證加速平臺。   Cad
          • 關鍵字: CADENCE  

          EPA控制網絡中ZigBee接入點的軟硬件設計

          • 在EPA網絡中,引入ZigBee技術是新提出的研究課題。本文在分析ZigBee技術的基礎上,對ZigBee技術接入EPA控制網絡進行系統(tǒng)建模和設計,給出ZigBee接入EPA控制網絡的實施方案及協(xié)議模型,并按照提出的方案設計一種EPAZigBee接入點設備。最后,對設計的接入點設備進行多次測試。分析測試結果表明,EPAZigBee接入點設備運行穩(wěn)定,工作可靠,可以滿足工作現(xiàn)場的多種需要。
          • 關鍵字: IEEE802.15.4 ZigBee接入   EPA   MAC   協(xié)議模型  

          基于IEEE802.15.4的無線VoIP話機系統(tǒng)

          •   摘要: 隨著網絡的普及,基于分組交換的VoIP技術得到迅猛發(fā)展。如何將VoIP技術與無線通信技術相結合,實現(xiàn)無線VoIP話機是當前嵌入式VoIP話機設計的一個新方向。本文提出了一種適用于家庭辦公室小范圍內的無線VoIP話機系統(tǒng)設計方案,并且將該方案在具體的硬件平臺上付諸實現(xiàn)。本文重點介紹了該系統(tǒng)的設計特點,無線MAC層的設計,以及手持設備端的硬件結構和軟件結構。   關鍵詞: IEEE802.15.4;mC/OS-II;SIP;g.726   當前VoIP技術和無線通信技術的迅速發(fā)展為無線VoIP
          • 關鍵字: 0712_A  雜志_技術長廊  IEEE802.15.4  mC/OS-II  SIP  g.726  音視頻技術  

          Cadence攜手ARM為多核與低功耗器件提供參考方法學

          •   Cadence設計系統(tǒng)公司與ARM 宣布推出兩種由它們聯(lián)合開發(fā)的新的實現(xiàn)參考方法學,一種用于ARM11(TM) MPCore(TM)多核處理器,另一種用于ARM1176JZF-S(TM)處理器的低功耗實現(xiàn),后者集成了ARM® Intelligent Energy Manager (IEM(TM))技術。針對這兩款ARM處理器的這些Cadence參考方法學是兩個公司緊密合作的成果,為設計多核、低功耗器件的共同客戶提供了增強的設計解決方案。   “Cadence低功耗解決方案包括Encounte
          • 關鍵字: 嵌入式系統(tǒng)  單片機  Cadence  ARM  處理器  MCU和嵌入式微處理器  

          CADENCE改進企業(yè)驗證產品提高工程師效率

          •   Cadence設計系統(tǒng)公司宣布為Cadence® Incisive® Enterprise驗證產品系列添加全新技術,讓工程師團隊能夠解決多模式手機、游戲機和HD-DVD播放器等產品越來越復雜的芯片設計問題。Incisive技術目前為新開發(fā)的開放型驗證方法學(OVM)提供支持,這是一種強大的全新面向方面生成引擎,也是Cadence事務型加速(TBA)的第二代,為多測試平臺語言提供本征支持,在不同驗證語言和各種與生產效率有關的方面都進行了改良。這種全新的面向方面生成引擎利用面向方面編程(A
          • 關鍵字: 嵌入式系統(tǒng)  單片機  Cadence  HD-DVD  消費電子  

          與蜂共舞—ZigBee技術一瞥

          •   摘要: 本文從ZigBee的發(fā)展歷史入手,探討了這種基于無線傳感器技術的網絡應用的協(xié)議棧、性能分析和各種應用領域,全面構建了完整的ZigBee技術應用與發(fā)展藍圖。   關鍵詞: 短距離無線通信;ZigBee;IEEE 802.15.4   概述   “ZigBee”是什么?從字面上猜像是一種蜜蜂。因為“ZigBee”這個詞由“Zig”和“Bee”兩部分組成,“Zig”取自英文單詞“zigzag”,意思是走“之”字形,“bee”英文是蜜蜂的意思,所以“ZigBee”就是跳著“之”字形舞的蜜蜂。不過
          • 關鍵字: 通訊  無線  網絡  0711_A  雜志_關注焦點  短距離無線通信  ZigBee  IEEE  802.15.4  通信基礎  

          Cadence喜迎第100家Encounter Timing System用戶

          •   Cadence設計系統(tǒng)公司宣布創(chuàng)新的 Cadence® Encounter® Timing System 簽收解決方案自從一年前推出以來,已經為100家客戶所采用和配置。Encounter Timing System目前已經被TSMC、Freescale 半導體和智原科技.等公司采用,在無論是網絡,通訊器件還是微處理器和圖形芯片等尖端芯片的設計和開發(fā)上扮演著重要角色。Encounter Timing System目前正在被第99和100家客戶使用,他們是新成立不久的Luminary M
          • 關鍵字: 消費電子  Cadence  圖形芯片  微處理器  消費電子  

          Cadence推出面向最新的Cadence® Virtuoso®平臺版本的晶圓廠設計工具包

          •   Cadence設計系統(tǒng)公司與半導體晶圓廠UMC公司宣布推出面向最新的Cadence® Virtuoso®定制設計平臺(IC6.1)版本的UMC 65納米晶圓廠設計工具包(FDKs)。這一工具包將為設計師提供邏輯/模擬模式65納米標準性能(SP)和邏輯/模擬模式65納米低漏電(LL)工藝。Cadence Virtuoso技術有助于加速、混合信號和RF器件的精確芯片設計。   “這種65納米RF設計工具包的推出將會幫助我們的客戶更快地意識到我們的經過產品驗證的65納米SP 和RF LL技
          • 關鍵字: 嵌入式系統(tǒng)  單片機  Cadence  UMC  晶圓  

          采用創(chuàng)新思維,Cadence新工具讓45nm IC量產提速!

          •   45nm節(jié)點被稱為IC設計的分水嶺,因為在這一節(jié)點,不僅半導體材料特性、光刻技術已經接近極限,而且EDA工具也要面臨更高層次抽象、創(chuàng)新平臺、DFM、多電源域等諸多新挑戰(zhàn),針對這一節(jié)點上的EDA工具開發(fā)需要更多創(chuàng)新的思維和策略。因為挑戰(zhàn)很多,所以業(yè)界人士對45nm的芯片設計和制造未來憂心忡忡。不過,欣喜的是,在9月11日硅谷的CDNLive!用戶會議上,Cadence向領先的半導體設計者和經理們展示了自己的45nm設計流程。其對應的產品Cadence Encounter數字設計平臺因采用了創(chuàng)新的思維和策
          • 關鍵字: 創(chuàng)新思維  Cadence  45nm  IC量產  MCU和嵌入式微處理器  

          FARADAY選擇CADENCE VOLTAGESTORM用于高級65納米低功耗簽收

          •   Cadence設計系統(tǒng)公司與領先的ASIC和硅智產(SIP)無晶圓IC設計公司智原科技宣布智原已經采用Cadence® VoltageStorm® 功率分析技術進行低功耗簽收,并支持智原的尖端低功耗設計。智原使用VoltageStorm的靜態(tài)和動態(tài)功率分析檢驗其高級低功耗設計技術,包括功率門控、去耦合電容優(yōu)化和多電源多電壓(MSMV)規(guī)劃。   智原有一套現(xiàn)成的功率分析解決方案,目前已經成功發(fā)展到90納米級別。不過由于意識到了65納米及以下級別低功耗簽收帶來的新技術挑戰(zhàn),智原對目前市
          • 關鍵字: 嵌入式系統(tǒng)  單片機  Cadence  IC  ASIC  MCU和嵌入式微處理器  

          CADENCE公布新的RF技術簡化納米級無線設備芯片的設計

          •   Cadence設計系統(tǒng)公司宣布推出Virtuoso Passive Component Designer,這是一種面向電感、變壓器和傳輸線設計、分析與建模的完整流程。這種新技術讓模擬與RF設計師能夠輕易掌握無源元件的設計,迅速開發(fā)出復雜的無線SoC和RFIC。Virtuoso Passive Component Designer從感應系數、Q值和頻率等設計規(guī)范開始,幫助設計師為他們的特定應用和工藝技術自動生成最適宜的感應器件,實現(xiàn)更高的性能和更小的面積。內置的精確3D全波解算器用于檢驗生成的器件,不再
          • 關鍵字: 嵌入式系統(tǒng)  單片機  CADENCE  RF  芯片  模擬IC  
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