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          dsp+fpga 文章 最新資訊

          基于FPGA可編程振蕩器增強

          • 當今復(fù)雜的 FPGA 含有眾多用于實現(xiàn)各種電路與系統(tǒng)的功能塊,諸如邏輯陣列、存儲器、DSP 模塊、處理器、用于時序生成的鎖相環(huán) (PLL) 和延遲鎖定環(huán) (DLL
          • 關(guān)鍵字: FPGA  控制  

          基于FPGA的三相正弦DDS電路的設(shè)計與實現(xiàn)

          • 1. 引言直接數(shù)字頻率合成器(DDS)技術(shù),是根據(jù)相位的概念出發(fā)直接合成所需的波形的一種 新的頻率合成原理,是一種把一系列數(shù)字形式的信號通過DAC轉(zhuǎn)換成模
          • 關(guān)鍵字: 控制  FPGA  

          基于Xilinx Zynq SoC的解決方案

          • 在移動互聯(lián)、智能終端的高速發(fā)展和普及下,網(wǎng)絡(luò)熱點和盲點急需靈活的方案來完善覆蓋。 由于基站選址和工程施工難度越來越大,施工成本越來越高,基站設(shè)
          • 關(guān)鍵字: FPGA  控制  

          基于Nios軟CPU內(nèi)核的FPGA非線性校正方案

          • 1. 引言O(shè)FDM能有效抑制多徑信道引起的深度衰落、抵抗脈沖噪聲和具有較高的頻譜效率的特點。但是OFDM的傳輸符號是多載波的QAM信號經(jīng)過IFFT處理后得到的
          • 關(guān)鍵字: 射頻  FPGA  

          基于FPGA的簡易電壓表設(shè)計

          •   傳統(tǒng)的數(shù)字電壓表設(shè)計通常以大規(guī)模ASIC(專用集成電路)為核心器件,并輔以少量中規(guī)模集成電路及顯示器件構(gòu)成。這種電壓表的設(shè)計簡單、精確度高,但是由于采用了ASIC器件使得它欠缺靈活性,其系統(tǒng)功能固定,難以更新擴展。而應(yīng)用FPGA設(shè)計的電壓表,采用FPGA芯片控制通用A/D轉(zhuǎn)換器,可使速度、靈活性大大優(yōu)于通用數(shù)字電壓表。、  本文采用STEP-MAX10M08核心板和STEP Base Board V3.0底板來完成簡易電壓表設(shè)計,我們將設(shè)計拆分成三個功能模塊實現(xiàn):  ADC081S101_driver
          • 關(guān)鍵字: FPGA  ASIC  

          基于FPGA的嵌入式視覺的應(yīng)用

          • 什么樣的積極創(chuàng)新可以幫助您設(shè)計出這樣一個系統(tǒng)mdash;mdash;它能夠提醒用戶有兒童在游泳池中溺水,或是有入侵者試圖闖入住宅或者辦公場所?這種技術(shù)還
          • 關(guān)鍵字: 嵌入式  FPGA  

          加快設(shè)計流程的兩種嵌入式系統(tǒng)開發(fā)方案的設(shè)計

          • 在日益信息化的現(xiàn)代社會中,計算機和網(wǎng)絡(luò)的應(yīng)用已經(jīng)全面滲透到日常生活中,各種應(yīng)用嵌入式系統(tǒng)的電子產(chǎn)品也隨處可見,計算機的應(yīng)用經(jīng)過桌面PC系統(tǒng)的空
          • 關(guān)鍵字: 嵌入式  FPGA  

          采用帶有收發(fā)器的全系列40-nm FPGA 和ASIC 實現(xiàn)創(chuàng)新設(shè)計

          • 人們對寬帶服務(wù)的帶寬要求越來越高,促使芯片供應(yīng)商使用更多的高速串行收發(fā)器。因此,下一代應(yīng)用采用了多種數(shù)據(jù)速率,從幾Mbps 到數(shù)百Gbps,在一種
          • 關(guān)鍵字: FPGA  ASIC  40  nm  

          基4-FPGA的大動態(tài)范圍數(shù)字AGC的實現(xiàn)

          • 1 引言在數(shù)字中頻接收機中,把A/D轉(zhuǎn)換提前到中頻部分,為保證A/D轉(zhuǎn)換的動態(tài)范圍和系統(tǒng)帶寬,要求低噪聲放大器和自動增益控制AGC(Automatic Ga
          • 關(guān)鍵字: FPGA  AGC  動態(tài)范圍  數(shù)字  

          提高DSP代碼運行性能的研究

          • 提高DSP代碼運行性能的研究,1 引言
            隨著微控制器技術(shù)的發(fā)展,以TI公司TMS320C2000系列為代表的DCS型數(shù)字信號處理器DSP應(yīng)用廣泛。該類型DSP內(nèi)部集成Flash存儲器,可將二進制代碼同化到其內(nèi)部的Flash存儲器直接運行。這種運行方式在傳統(tǒng)嵌入
          • 關(guān)鍵字: DSP  代碼  運行  性能  

          基于DSP的太陽光線自動跟蹤系統(tǒng)設(shè)計與實現(xiàn)

          • 基于DSP的太陽光線自動跟蹤系統(tǒng)設(shè)計與實現(xiàn),1 引言
            精確捕捉太陽光線可提高太陽能裝置,尤其是聚光類太陽能裝置的太陽能利用率?,F(xiàn)有的聚光類太陽能發(fā)電系統(tǒng)主要采用程序控制、傳感器控制、程序與傳感器聯(lián)合控制的方法。程序控制方法是計算出太陽在一天中
          • 關(guān)鍵字: DSP  光線  自動跟蹤  系統(tǒng)設(shè)計  

          基于FPGA的正交數(shù)字混頻器中數(shù)控振蕩器的設(shè)計與實現(xiàn)

          • 要CORDIC(COordination Rotation DIgital Computer)算法實現(xiàn)正交數(shù)字混頻器中的數(shù)控振蕩器的方法。首先推導(dǎo)了算法產(chǎn)生正余弦信號的實現(xiàn)過程,然后給出了
          • 關(guān)鍵字: FPGA  正交數(shù)字  混頻器  數(shù)控振蕩器  

          積分梳狀濾波器的FPGA實現(xiàn)

          • 本文提出了多級CIC抽取濾波器結(jié)構(gòu)不僅能夠?qū)崿F(xiàn)更寬輸入信號的任意速率的抽取,并且對帶外信號的衰減也更大。
          • 關(guān)鍵字: FPGA  積分  梳狀濾波器  

          FPGA工作原理與簡介

          •   FPGA工作原理與簡介  如前所述,F(xiàn)PGA是在PAL、GAL、EPLD、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為ASIC領(lǐng)域中的一種半定制電路而出現(xiàn)的,即解決了定制電路的不足,又克服了原有可編程器件門電路有限的缺點?! ∮捎贔PGA需要被反復(fù)燒寫,它實現(xiàn)組合邏輯的基本結(jié)構(gòu)不可能像ASIC那樣通過固定的與非門來完成,而只能采用一種易于反復(fù)配置的結(jié)構(gòu)。查找表可以很好地滿足這一要求,目前主流FPGA都采用了基于SRAM工藝的查找表結(jié)構(gòu),也有一些軍品和宇航級FPGA采用Flash或者熔絲與反熔
          • 關(guān)鍵字: FPGA  Xilinx  Altera  

          常用FPGA/CPLD四種設(shè)計技巧

          • 常用FPGA/CPLD四種設(shè)計技巧,FPGA/CPLD的設(shè)計思想與技巧是一個非常大的話題,本文僅介紹一些常用的設(shè)計思想與技巧,包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意,如果能有意識地利用這些原則指導(dǎo)日
          • 關(guān)鍵字: FPGA  CPLD  設(shè)計技巧  
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          dsp+fpga介紹

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