1.概述 近年來，以電池作為電源的電子產(chǎn)品得到廣泛使用，設(shè)計師迫切要求采用低電壓的模擬電路來降低功耗。低電壓、低功耗、低噪聲的模擬電路設(shè)計技術(shù)正成為研究的熱點。從節(jié)約能源角度考慮，低的功率消耗不僅是
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應(yīng)用 設(shè)備 便攜 設(shè)計 功耗
對降低地址總線功耗的編碼方法研究與應(yīng)用正在逐漸增多。本文在簡述地址總線上的功耗來源的基礎(chǔ)上，介紹了幾種典型的地址總線低功耗編碼方法，通過結(jié)合實際采用的T0編碼，能有效地降低智能卡芯片的功耗。
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設(shè)計 實現(xiàn) 編碼 功耗 總線 地址
摘 要:研究了門控時鐘技術(shù)在130 nm工藝、基于高閾值標(biāo)準(zhǔn)單元庫下的低功耗物理實現(xiàn)方法。詳細(xì)闡述了多級門控時鐘技術(shù)的作用機制和參數(shù)的設(shè)置方法，給出了基于門控時鐘的后端實現(xiàn)流程，著重分析了插入門控時鐘對時鐘
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實現(xiàn) 方案 電路 功耗 時鐘 基于
具有低功耗意識的FPGA設(shè)計方法, 工業(yè)、汽車電子、軍事, 甚至商業(yè)類客戶都會對系統(tǒng)的溫度和運行模式的概況有規(guī)定。這些概況指引我們在設(shè)計時要注意哪些地方以及精力該如何分配。IGLOO器件的低功耗工藝和硅片設(shè)計由Actel來保證，用戶所要關(guān)注的是：
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設(shè)計 方法 FPGA 意識 功耗 具有
在嵌入式設(shè)計中降低CPLD的功耗,從事便攜式或手持產(chǎn)品設(shè)計的工程師都明白對于如今的設(shè)計，最大限度地降低功耗是必不可少的要求。但是，只有經(jīng)驗豐富的工程師理解盡可能地延長系統(tǒng)的電池壽命的那些微妙但又重要的細(xì)節(jié)。本文中我們將重點放在這些經(jīng)驗
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功耗 CPLD 降低 設(shè)計 嵌入式
如何控制IC的功耗,在許多設(shè)計中，功耗已經(jīng)變成一項關(guān)鍵的參數(shù)。在高性能設(shè)計中，超過臨界點溫度而產(chǎn)生的過多功耗會削弱可靠性。在芯片上表現(xiàn)為電壓下降，由于片上邏輯不再是理想電壓條件下運行的那樣，功耗甚至?xí)绊憰r序。為了處理功
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功耗 IC 控制 如何
基于HYM8563的80C51系列單片機低功耗系統(tǒng)設(shè)計,介紹一種利用I2C實時時鐘芯片HYM8563產(chǎn)生的多種中斷方式,喚醒進入掉電狀態(tài)的80C51系列單片機，由此技術(shù)構(gòu)建的低功耗單片機系統(tǒng)。
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功耗 系統(tǒng) 設(shè)計 單片機 系列 HYM8563 80C51 基于
如今的無線設(shè)備中，線路板上一半以上的元件都是模擬RF器件，因此要縮小線路板面積和功耗一個有效方法就是進行更大規(guī)模RF集成，并向系統(tǒng)級芯片方向發(fā)展。本文介紹RF集成發(fā)展現(xiàn)狀，并對其中一些問題提出應(yīng)對方法和解決
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線路板 面積 功耗 手機 減少 RF 集成 大規(guī)模
在做硬件系統(tǒng)設(shè)計時,需要選擇正確的電源供電芯片，無論是設(shè)計消費數(shù)碼電子還是無線傳感設(shè)備,需要權(quán)衡好產(chǎn)品的各個功能需求。在對噪聲抑制、耗電量、壓降、和電源電壓電流等指標(biāo)做出評估和劃定優(yōu)先級后,才可以進行電源
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感想 設(shè)計 電源 噪聲 功耗
電源軌一般用于為微控制器的電壓基準(zhǔn)源供電。在功率關(guān)鍵的電池供電應(yīng)用中，即使持續(xù)數(shù)10s的毫安級電流也是被禁止的。這種情況下，需要增加一個用于控制基準(zhǔn)電壓通斷的管腳。通過與電壓基準(zhǔn)源并聯(lián)一個0.1mu;F電容，并
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基準(zhǔn) 電壓 功耗 只管 僅需
以前,低功率穩(wěn)壓通常使用線性穩(wěn)壓器,只要輸入和輸出電壓之間的壓差不是太大,他們相對低的效率還是可接受的。但是,如果輸入電壓不穩(wěn)定,那么輸入電壓和輸出電壓差值可能會比較大,這會導(dǎo)致更大的內(nèi)部損耗,更低的效率以及
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轉(zhuǎn)換器 應(yīng)用 指南 電源 功耗 R-78XX 系列 RECOM
本文介紹了TI公司最新推出的適合DSP低功耗電源系統(tǒng)設(shè)計的開關(guān)電源芯片，并設(shè)計了基于該芯片的雙電源方案，滿足DSP系統(tǒng)要求的上電順序。
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設(shè)計 功耗 系統(tǒng) 電源 DSP
嵌入式零功耗系統(tǒng)設(shè)計研究,嵌入式應(yīng)用系統(tǒng)中，普遍存在功耗浪費現(xiàn)象。
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研究 設(shè)計 系統(tǒng) 功耗 嵌入式
FPGA低功耗設(shè)計注意事項,FPGA的功耗高度依賴于用戶的設(shè)計，沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低，如同其它多數(shù)事物一樣，降低功耗的設(shè)計就是一種協(xié)調(diào)和平衡藝術(shù)，在進行低功耗器件的設(shè)計時，人們必須仔細(xì)權(quán)衡性能、易用性、成本、密度
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注意事項 設(shè)計 功耗 FPGA
FPGA的低功耗設(shè)計分析,FPGA的功耗高度依賴于用戶的設(shè)計，沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低，在進行低功耗器件的設(shè)計時，人們必須仔細(xì)權(quán)衡性能、易用性、成本、密度以及功率等諸多指標(biāo)?！ ”M管基于90nm工藝的FPGA的功耗已低于先
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分析 設(shè)計 功耗 FPGA
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