FPGA在彈上信息處理機中的應(yīng)用
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引言
本文引用地址：http://yuyingmama.com.cn/article/93424.htm信息處理機(圖1)用于完成導(dǎo)彈上多路遙測信息的采集、處理、組包發(fā)送。主要功能包括高速1553B總線的數(shù)據(jù)收發(fā) 、422接口設(shè)備的數(shù)據(jù)加載與檢測、多路數(shù)據(jù)融合和數(shù)據(jù)接收、處理、組包發(fā)送的功能。其中，總線數(shù)據(jù)和其他422接口送來的數(shù)據(jù)同時進行并行處理;各路輸入信息按預(yù)定格式進行融合與輸出;數(shù)據(jù)輸出速率以高速同步422口的幀同步脈沖為源，如果高速同步422口異常不影響總線數(shù)據(jù)和其它422口的數(shù)據(jù)融合與輸出功能。在CPU發(fā)生異?；蚩偩€數(shù)據(jù)異常時不影響其它422口數(shù)據(jù)的融合與輸出功能;能夠?qū)目偩€上接收的數(shù)據(jù)進行二次篩選、組包，并發(fā)送往總線，供其它設(shè)備接收。
圖1 信息處理機功能框圖彈上功能框圖
系統(tǒng)設(shè)計
CPU選擇
4M 1553B總線數(shù)據(jù)的采集，由4M總線智能通訊接口管理，經(jīng)CPU接收、組包，再回到4M總線，發(fā)送至FPGA進行采集。CPU選擇Atmel公司的AT91FR40162S, 內(nèi)部自帶256KB的SRAM和容量為2M x 8b FLASH存儲器，主頻最高可達75MHz。該ARM的等待電路由硬件等待邏輯產(chǎn)生，在FPGA內(nèi)部實現(xiàn)。ARM外部中斷源主要有：4M 1553B通訊控制器中斷;20ms緩沖區(qū)切換中斷。其中，4M 1553B通訊控制器中斷信號經(jīng)過FPGA整形后送入ARM。20ms緩沖區(qū)切換中斷提供給FPGA內(nèi)部各個同步、異步通訊IP組幀狀態(tài)機用于緩沖區(qū)切換。
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