一種基于FPGA的NoC驗證平臺的構建
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圖4給出了在不同流量模型下，每包4個數(shù)據(jù)片時，所設計NoC的網(wǎng)絡平均吞吐量。
2)平均網(wǎng)絡延遲 對于TR收集到的最近80個數(shù)據(jù)包從發(fā)送端到接收端的延遲信息，以歸一化仿真時間為基準，計算平均網(wǎng)絡延遲：
式中，P是發(fā)包總數(shù)，每個包的延遲為Li，那么Latency就是一段時間內(nèi)的平均網(wǎng)絡延遲。
圖5給出了在不同流量模型下，在相同仿真時間段中接收到的數(shù)據(jù)包的平均網(wǎng)絡延遲。圖6給出了在相同的流量模型-均勻地址，自相似流量模型下，在相同仿真時間段中，對于每包分片不同時的平均網(wǎng)絡延遲。
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