為了測試FPGA芯片內(nèi)部所實(shí)現(xiàn)的DAB信號調(diào)制系統(tǒng)，從電腦端通過PCIe向FPGA芯片傳送一個(gè)任意數(shù)據(jù)文件，作為激勵整數(shù)源，這個(gè)數(shù)據(jù)文件的起始部分包含了十六進(jìn)制數(shù)據(jù)串“DEAD BEEF”，用來開啟FPGA芯片中的DAB信號調(diào)制系統(tǒng)。經(jīng)過信號調(diào)制系統(tǒng)實(shí)時(shí)處理后的信號數(shù)據(jù)被傳回電腦端，并記錄在一個(gè)名為dabout．data的數(shù)據(jù)文件中，利用MATLAB軟件打開并分析這個(gè)數(shù)據(jù)文件，驗(yàn)證其所記錄的信號是否具有要求的時(shí)域幀結(jié)構(gòu)及OFDM信號的頻譜特性。測試平臺的搭建如圖7所示。

通過對dabout．data文件的分析，DAB信號調(diào)制系統(tǒng)所實(shí)時(shí)處理輸出的信號具備完整的幀結(jié)構(gòu)，并且其頻譜特性良好，圖8、圖9為分析得到的時(shí)域及頻域結(jié)果。

結(jié)語

本文利用基于模型沒汁的思想，通過算法層和硬件層建模，利用Simulink平臺和Xilinx公司提供的可編譯硬件模型庫，設(shè)計(jì)并在FPGA芯片中實(shí)現(xiàn)了Eureka 147數(shù)字音頻廣播基帶信號處理鏈中的信號調(diào)制系統(tǒng)。實(shí)際測試表明，所沒汁的系統(tǒng)能夠?qū)崟r(shí)處理輸入數(shù)據(jù)流，并且所提供的輸出信號滿足DAB基帶信號的時(shí)域幀結(jié)構(gòu)和頻域譜特征的要求。