pcie 4.0 phy ip 文章最新資訊

Mentor Graphics宣布推出新的用于PCIe 4.0的驗(yàn)證IP

　　Mentor Graphics公司今天宣布其新的Mentor®EZ-VIP PCI Express驗(yàn)證IP的即時(shí)可用性。這一新的驗(yàn)證IP (VIP)可將ASIC(應(yīng)用程序特定集成電路)和FPGA(現(xiàn)場(chǎng)可編程門陣列)設(shè)計(jì)驗(yàn)證的測(cè)試平臺(tái)構(gòu)建時(shí)間減少多達(dá)10倍。　　驗(yàn)證IP旨在通過為常見協(xié)議和架構(gòu)提供可復(fù)用構(gòu)建模塊來幫助工程師減少構(gòu)建測(cè)試平臺(tái)所花費(fèi)的時(shí)間。然而，即使是標(biāo)準(zhǔn)協(xié)議和常見架構(gòu)，其配置和實(shí)施也可能會(huì)因設(shè)計(jì)而異。因此，傳統(tǒng)的VIP元件可能需要數(shù)天甚至數(shù)周來準(zhǔn)備模擬或仿真測(cè)試平臺(tái)。　　&
關(guān)鍵字： Mentor Graphics IP SoC

安森美半導(dǎo)體新一代外圍組件快速互連(PCIe)方案優(yōu)化服務(wù)器時(shí)鐘應(yīng)用

　　網(wǎng)絡(luò)/無線/云計(jì)算、數(shù)字消費(fèi)、自動(dòng)測(cè)試設(shè)備(ATE)/工業(yè)等應(yīng)用市場(chǎng)的不斷發(fā)展令時(shí)鐘技術(shù)在性能和靈活性的結(jié)合越趨重要，而且越來越多的應(yīng)用要求實(shí)時(shí)時(shí)鐘在寬溫度范圍內(nèi)有極高的計(jì)時(shí)精度。安森美半導(dǎo)體(ON Semiconductor)為滿足市場(chǎng)對(duì)更高時(shí)鐘精度的需求，不斷開發(fā)和拓展完整時(shí)鐘解決方案，降低時(shí)間抖動(dòng)和相位噪聲，同時(shí)使系統(tǒng)設(shè)計(jì)更加簡(jiǎn)單易行。　　不同應(yīng)用市場(chǎng)對(duì)時(shí)鐘方案的需求　　不同應(yīng)用市場(chǎng)對(duì)時(shí)鐘方案的需求各有特點(diǎn)。例如，網(wǎng)絡(luò)、無線和云計(jì)算領(lǐng)域需要低于1ps的抖動(dòng)及低相位噪聲，采用晶體振蕩器(X
關(guān)鍵字： PCIe 時(shí)鐘服務(wù)器

新思科技Synopsys虛擬原型設(shè)計(jì)專著發(fā)行超3000本，讀者覆蓋超1000家公司

　　為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識(shí)產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司(Synopsys, Inc.)日前宣布：其關(guān)于虛擬原型技術(shù)的專著《更快地開發(fā)出更好的軟件!(Better Software. Faster!)》已實(shí)現(xiàn)超過3000本的發(fā)行量，覆蓋了1000多家公司。此書的廣泛發(fā)行表明：業(yè)界正日漸把虛擬原型設(shè)計(jì)看作是一種可幫助他們?cè)谠O(shè)計(jì)周期的更早階段就開始軟件開發(fā)并加速其項(xiàng)目進(jìn)度的方法。Synopsys已將此書翻譯為簡(jiǎn)體中文，日文版將于今年年底前提供。　　“隨著移動(dòng)
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基于Blackfin的智能IP Camera系統(tǒng)設(shè)計(jì)

　　1.背景及概述　　近年來，隨著嵌入式應(yīng)用越來越復(fù)雜，應(yīng)用場(chǎng)合越來越多，特別是多媒體功能在各個(gè)領(lǐng)域飛速發(fā)展，高性能計(jì)算變得無處不在，從消費(fèi)電子，網(wǎng)絡(luò)通訊到工業(yè)控制和監(jiān)控，大多數(shù)應(yīng)用都需要更高的數(shù)字信號(hào)處理能力。出于成本和設(shè)計(jì)難度的考慮，人們傾向于使用單顆芯片完成所有的工作，傳統(tǒng)的DSP處理器和MCU處理器開始以多種形式進(jìn)行融合：　　1.傳統(tǒng)的MCU+DSP合作方案被集成到一顆芯片封裝內(nèi);或者進(jìn)一步實(shí)現(xiàn)為真正的異構(gòu)多核，可以共享部分甚至全部外部設(shè)備。　　2.以SoC的形式為MCU加上基于固定硬
關(guān)鍵字： Blackfin IP Camera DSP

基于FPGA的報(bào)文數(shù)據(jù)分析模塊的設(shè)計(jì)

　　摘要：網(wǎng)絡(luò)報(bào)文數(shù)據(jù)的記錄和分析在智能化變電站中尤為重要，通過對(duì)整個(gè)通信過程的記錄可以為事故分析及運(yùn)行維護(hù)提供依據(jù)。本文提出了一種基于FPGA技術(shù)、結(jié)合相關(guān)通信協(xié)議的報(bào)文數(shù)據(jù)分析系統(tǒng)的設(shè)計(jì)方案，實(shí)現(xiàn)了報(bào)文數(shù)據(jù)分析系統(tǒng)的各功能子模塊，通過仿真運(yùn)行驗(yàn)證了系統(tǒng)良好的處理能力。　　引言　　隨著計(jì)算機(jī)技術(shù)、通信技術(shù)及網(wǎng)絡(luò)技術(shù)的迅速發(fā)展，基于這三種核心技術(shù)的自動(dòng)化智能裝置在電網(wǎng)控制中的作用越來越突出。其中以交換式以太網(wǎng)和光纖光纜實(shí)現(xiàn)的網(wǎng)絡(luò)通信系統(tǒng)已經(jīng)逐漸成為變電站的重要單元。　　如何記錄、分析某個(gè)智能單
關(guān)鍵字： FPGA 以太網(wǎng) IEC61850 PHY CPU MAC 201411

Synopsys全新DesignWare MIPI D-PHY將面積和功耗縮減50%

　　為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識(shí)產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司(Synopsys, Inc.)日前宣布：已將其DesignWare® MIPI® D-PHY™的面積和功耗降低到了競(jìng)爭(zhēng)性方案的50%，同時(shí)將性能提升至每通道2.5 Gbps，為移動(dòng)、消費(fèi)類和汽車應(yīng)用降低了系統(tǒng)級(jí)芯片(SoC)的芯片成本并延長(zhǎng)了電池續(xù)航能力。由于符合MIPI D-PHY v1.2規(guī)范，同時(shí)作為還包括DesignWare MIPI DSI 和 CSI-2 Controlle
關(guān)鍵字： Synopsys SoC D-PHY

機(jī)頂盒與節(jié)能

　　每年年初，我家都會(huì)盡量省著點(diǎn)用錢。一般都以相同的方式開始：非常嚴(yán)格，甚至有些苛刻。我們下飯館的次數(shù)比往常有所減少，用電更節(jié)約，而且上班帶飯?jiān)谵k公室吃。我妻子是我們家的首席財(cái)務(wù)官，因此她會(huì)準(zhǔn)備一個(gè)節(jié)約事項(xiàng)清單。無論好壞，短期內(nèi)我們都不能大手大腳地花錢，得回歸過去的老習(xí)慣?！　〔贿^今年情況有了變化。我們有一部 13 年前安裝的座機(jī)電話。我們每月都付電話費(fèi)，但服務(wù)質(zhì)量從未改善，而且也未曾降價(jià)。于是我們決定試試 IP 電話。通過停用座機(jī)電話，再加上有線電視供應(yīng)商提供的優(yōu)惠，我們每月可節(jié)省大約 100 美元。節(jié)
關(guān)鍵字： IP 電話有線電視盒電源管理策略

利用信號(hào)平均技術(shù)，消除噪聲干擾，提升重復(fù)信號(hào)采樣的精準(zhǔn)度

　　許多高速數(shù)據(jù)采集應(yīng)用，如激光雷達(dá)或光纖測(cè)試等，都需要從嘈雜的環(huán)境中采集小的重復(fù)信號(hào)，因此對(duì)于數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)來說，最大的挑戰(zhàn)就是如何最大限度地減少噪聲的影響。利用信號(hào)平均技術(shù)，可以讓您的測(cè)量測(cè)試系統(tǒng)獲取更加可靠的、更加有效的測(cè)試數(shù)據(jù)。　　通常情況下，在模擬信號(hào)的測(cè)試中，所采集到的數(shù)據(jù)往往夾雜著一些不需要的、隨機(jī)的內(nèi)容，這些數(shù)據(jù)是由周圍的干擾或者測(cè)試誤差所引起的，我們稱之為隨機(jī)噪聲，這種噪聲可能會(huì)影響我們的目標(biāo)信號(hào)，也就是我們需要采集的數(shù)據(jù)。而采用信號(hào)平均技術(shù)，則可以減少隨機(jī)噪聲的影響，提升信噪比
關(guān)鍵字：凌華 FPGA DSP PCIe-9852 201409

華虹宏力攜手硅視覺，在其0.11微米技術(shù)平臺(tái)上共推硅驗(yàn)證智能藍(lán)牙射頻IP

　　世界領(lǐng)先的8英寸純晶圓代工廠之一，上海華虹宏力半導(dǎo)體制造有限公司(以下簡(jiǎn)稱“華虹宏力”)，與硅視覺技術(shù)有限公司(以下簡(jiǎn)稱“硅視覺”)，一家領(lǐng)先的知識(shí)產(chǎn)權(quán)(IP)提供商，提供高性能、低功率射頻知識(shí)產(chǎn)權(quán)，今天宣布攜手合作，在華虹宏力0.11微米混合信號(hào)/射頻技術(shù)平臺(tái)上推出了藍(lán)牙低功耗IP。這款通過硅驗(yàn)證的IP已被授權(quán)給一家客戶，該客戶應(yīng)用藍(lán)牙技術(shù)開發(fā)了無線鍵盤鼠標(biāo)等人機(jī)接口設(shè)備。為滿足集成藍(lán)牙模塊的無線MCU需求，接下來將很快在華虹宏力射頻嵌入式非易失性存儲(chǔ)
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Synopsys發(fā)布業(yè)界首款完整的PCI Express 4.0 IP解決方案

　　為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識(shí)產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司(Synopsys, Inc.，納斯達(dá)克股票市場(chǎng)代碼：SNPS)日前發(fā)布了業(yè)界首款完整的PCI Express 4.0 IP解決方案，它由DesignWare PHY、控制器和Verification IP(VIP)組成，專門針對(duì)諸如服務(wù)器、網(wǎng)絡(luò)設(shè)備、存儲(chǔ)系統(tǒng)以及固態(tài)硬盤(SSD)等企業(yè)級(jí)計(jì)算應(yīng)用。PCI Express 4.0是PCI Express I/O的下一代標(biāo)準(zhǔn)，其吞吐量增加了一倍至16 GT/s，目前外
關(guān)鍵字： Synopsys PCI Express IP

Altera與Cavium合作，為網(wǎng)絡(luò)應(yīng)用提供經(jīng)過預(yù)驗(yàn)證的數(shù)據(jù)包分類解決方案

　　Altera公司(NASDAQ: ALTR)近日宣布，其Interlaken旁視知識(shí)產(chǎn)權(quán)(IP)內(nèi)核通過了測(cè)試，與Cavium的NEURON Search?處理器兼容?！　∵@一可立即部署實(shí)施、經(jīng)過預(yù)先驗(yàn)證的解決方案為網(wǎng)絡(luò)OEM提供了低延時(shí)、高性能數(shù)據(jù)包接口，適用于包括路由器、交換機(jī)、防火墻以及安全存儲(chǔ)在內(nèi)的多種網(wǎng)絡(luò)應(yīng)用。Interlaken旁視IP內(nèi)核目前以Altera系列同類最佳IP內(nèi)核組成的形式提供，經(jīng)過優(yōu)化，集成在Altera Arria? 10和Stratix? V FPGA中，具有性能優(yōu)異、
關(guān)鍵字： Altera IP Cavium

Synopsys發(fā)起的“IP Accelerated”計(jì)劃重新定義了IP供應(yīng)商范式

　　為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識(shí)產(chǎn)權(quán)(IP)及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司(Synopsys, Inc.，納斯達(dá)克股票市場(chǎng)代碼：SNPS)日前宣布：推出其名為“IP Accelerated”的IP加速計(jì)劃，以幫助設(shè)計(jì)師顯著地減少在其系統(tǒng)級(jí)芯片(SoC)中集成IP所需的時(shí)間和工作量。該計(jì)劃擴(kuò)展了Synopsys已有的、多樣化的、已流片驗(yàn)證過的DesignWare? IP產(chǎn)品組合，增加了全新的IP Prototyping Kits原型設(shè)計(jì)套件、IP Virtual Development K
關(guān)鍵字： Synopsys IP SoC

一種基于ARM的嵌入式TCP/IP協(xié)議的簡(jiǎn)化方案

　　摘要：介紹嵌入式TCP/IP協(xié)議在低速處理器中的一種簡(jiǎn)化實(shí)現(xiàn)方案，并成功應(yīng)用于某分布式監(jiān)控系統(tǒng)中。　　關(guān)鍵詞：TCP/IP協(xié)議嵌入式　　ARM 在網(wǎng)絡(luò)應(yīng)用日益普遍的今天，越來越多的嵌入式設(shè)備實(shí)現(xiàn)Internet網(wǎng)絡(luò)化。TCP/IP協(xié)議是一種目前被廣泛采用的網(wǎng)絡(luò)協(xié)議。嵌入式Internet的技術(shù)核心是在嵌入式系統(tǒng)中部分或完整地實(shí)現(xiàn)TCP/IP協(xié)議。由于TCP/IP協(xié)議比較復(fù)雜，而目前嵌入式系統(tǒng)中大量應(yīng)用低速處理器，受內(nèi)存和速度限制，有必要將TCP/IP協(xié)議簡(jiǎn)化。圖1 協(xié)議處理 1 TCP/I
關(guān)鍵字： ARM 嵌入式 TCP/IP

2013年全球前十大半導(dǎo)體IP供應(yīng)商排行榜

　　根據(jù)市場(chǎng)研究機(jī)構(gòu) Gartner 的最新統(tǒng)計(jì)數(shù)據(jù)，Cadence Design Systems在 2013年躋身全球前四大半導(dǎo)體 IP供應(yīng)商，主因是該公司在IP業(yè)務(wù)策略上改弦更張，并收購了Tensilica 與 Cosmic Circuits等公司;Cadence在2012年的Gartner的半導(dǎo)體IP供應(yīng)商排行榜上還擠不進(jìn)前十名。　　根據(jù) Gartner 的統(tǒng)計(jì)，全球半導(dǎo)體IP市場(chǎng)在2013年成長(zhǎng)了11.5%，市場(chǎng)規(guī)模24.5億美元;其中處理器核心供應(yīng)商 ARM 為市占率43.2%的龍頭，排
關(guān)鍵字： Gartner IP 半導(dǎo)體 201406

賽普拉斯與IDEX達(dá)成戰(zhàn)略合作伙伴關(guān)系開發(fā)先進(jìn)指紋識(shí)別解決方案

　　賽普拉斯半導(dǎo)體公司日前宣布，與IDEX ASA建立新型戰(zhàn)略合作伙伴關(guān)系，開發(fā)指紋識(shí)別解決方案。根據(jù)雙方的協(xié)議，賽普拉斯將在為客戶提供其業(yè)界領(lǐng)先的TrueTouch? 觸摸屏控制器、CapSense?觸摸感應(yīng)控制器和 trackpad解決方案的同時(shí)，提供基于IDEX屢獲殊榮的指紋成像和識(shí)別技術(shù)的指紋識(shí)別方案。這一組合將使智能手機(jī)、平板電腦、可穿戴設(shè)備、身份證和一系列物聯(lián)網(wǎng)應(yīng)用中用戶界面和個(gè)人安全系統(tǒng)的設(shè)計(jì)過程更加方便流暢?！　?duì)于攜帶個(gè)人用戶重要信息的聯(lián)網(wǎng)設(shè)備而言，安全性至關(guān)重要。IDEX已開發(fā)出獨(dú)一無
關(guān)鍵字：賽普拉斯 IDEX IP