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系統(tǒng)級語言SystemVerilog和SystemC的融合
- SystemVerilog和SystemC不久前依然被視為相互排斥的兩種環(huán)境，而現(xiàn)在可以相互協(xié)作，并為實現(xiàn)設計和驗證方法提供平滑流暢的系統(tǒng)。
- 關鍵字： SystemVerilog SystemC 驗證 系統(tǒng)級
基于SystemC描述的嵌入式系統(tǒng)的自動化驗證
- 摘要:基于SystemC的嵌入式系統(tǒng)描述,提出了一種全新的自動化驗證方法。該方法采用面向方面編程技術、分離...
- 關鍵字： 嵌入式系統(tǒng) SystemC 設計語言
基于SystemC的系統(tǒng)級芯片設計方法研究
- 隨著集成電路制造技術的迅速發(fā)展,SOC設計已經(jīng)成為當今集成電路設計的發(fā)展方向。SO C設計的復雜性對集成電路設計的各個層次,特別是對系統(tǒng)級芯片設計層次,帶來了新挑戰(zhàn)，原有的HDL難以滿足新的設計要求。 硬件設計領域有2種主要的設計語言：VHDL和Verilog HDL。而兩種語言的標準不統(tǒng)一，導致軟硬件設計工程師之間工作交流出現(xiàn)障礙,工作效率較低。因此，集成電路設計界一直在尋找一種能同時實現(xiàn)較高層次的軟件和硬件描述的系統(tǒng)級設計語言。Synopsys公司與Coware公司針對各方對系統(tǒng)級設計語言的
- 關鍵字： SOC SystemC 集成電路 VHDL Verilog HDL
基于模式的SoC設計方法研究
- 引 言 SoC(system on chip) 是微電子技術發(fā)展的一個新的里程碑，SoC不再是一種功能單一的單元電路，而是將信號采集、處理和輸出等完整的系統(tǒng)集成在一起，成為一個有專用目的的電子系統(tǒng)單片。其設計思想也有別于IC，在一個或若干個單片上完成整個系統(tǒng)的功能。 SoC開發(fā)和設計存在一些問題，如描述語言不統(tǒng)一、抽象層次低、仿真速度慢、可重用性差、設計性能無法保障、RTL級發(fā)現(xiàn)的問題需要重新進行整個的設計流程才能解決，因此SoC的建模與設計的方法成為當前刻不容緩的課題。上述種種問題與曾經(jīng)困
- 關鍵字： 嵌入式系統(tǒng) 單片機 SoC 面向對象 SystemC 嵌入式
在SoC設計中用SystemC虛擬平臺預覽USB的性能
- 現(xiàn)在的程序員和系統(tǒng)架構師有比以往更多的軟件可用于 SoC（單片系統(tǒng)）設計，但也面臨著一個日益困擾他們的問題：如何在設計前期，在硅片拿到手以前評估和優(yōu)化軟件的性能。為解決這個問題，程序員們轉向虛擬平臺，這種平臺采用軟件來對目標硬件的架構和功能建模。當設計師們小心地在其它軟件工具幫助下完成這個任務時，這些平臺被證明是有效的方法，可以對很多重要性能的度量做出早期評估，如有關嵌入軟件功能好壞及其與現(xiàn)有硬件的互相影響。虛擬平臺可以預測 CPU 效率、數(shù)據(jù)傳輸率以及緩存失中率、中斷等待時間、功能性熱點，以及其它性能的
- 關鍵字： SoC SystemC USB 單片機 嵌入式系統(tǒng) SoC ASIC
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