1553b-pci 文章 最新資訊
Cadence推出業(yè)界首款PCI Express 5.0驗(yàn)證IP 現(xiàn)可供貨
- 楷登電子(美國Cadence 公司， NASDAQ：CDNS)今日宣布，業(yè)界首款支持全新 PCI Express ® (PCIe®)5.0 架構(gòu)的驗(yàn)證 IP(VIP)正式可用。結(jié)合 TripleCheck™ 技術(shù)，Cadence® VIP 旨在幫助設(shè)計(jì)師快速執(zhí)行基于 PCIe 5.0 標(biāo)準(zhǔn)的服務(wù)器和存儲器的系統(tǒng)級芯片(SoC)設(shè)計(jì)的完整功能性驗(yàn)證，確保產(chǎn)品功能符合設(shè)計(jì)初衷。 如需進(jìn)一步了解基于PCIe 5.0架構(gòu)并采用TripleCheck技術(shù)的Cadence
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基于FPGA的1553B總線接口板設(shè)計(jì)
- 引言 目前國內(nèi)對1553B總線接口板的設(shè)計(jì)一般基于DDC公司BU-61580協(xié)議芯片完成，但只能完成協(xié)議處理部分，應(yīng)用時(shí)還需外圍的存貯器和微處理器等輔助芯片。故采用現(xiàn)場可編程門陣列(FPGA)實(shí)現(xiàn)整個(gè)接口板核心的設(shè)計(jì)。 1 系統(tǒng)總體架構(gòu) 1553B總線信號進(jìn)入接口板后，首先通過隔離變壓器進(jìn)行電平轉(zhuǎn)化，使之匹配后面收發(fā)器的工作電壓。收發(fā)器再把電平轉(zhuǎn)化后1553B差分信號轉(zhuǎn)化為可識別的TTL電平。但此時(shí)的信號仍然是曼徹斯特Ⅱ型碼，故需經(jīng)解碼和串并轉(zhuǎn)換，同時(shí)完成數(shù)據(jù)字的同步、數(shù)據(jù)、曼徹斯特碼
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什么是PCI Express 高速串行互聯(lián)接口標(biāo)準(zhǔn)？
- PCI Express是從PCI發(fā)展而來的一種系統(tǒng)互聯(lián)接口標(biāo)準(zhǔn)。PCI和PCI-X都是基于32位以及64位的并行總線，而PCI Express則使用高速串行總線。PCI Express后向兼容于PCI，能夠靈活地提供大峰值帶寬。
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什么是PCI Express 標(biāo)準(zhǔn)（中）
- 如圖 2 所示，即 PCI Express 的層次體系結(jié)構(gòu)。它保持了與 PCI 尋址模式（加載－存儲體系結(jié)構(gòu)且具有單層地址空間）的兼容性，從而保證了所有現(xiàn)有的應(yīng)用程序和驅(qū)動(dòng)操作無需改變
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什么是PCI Express 標(biāo)準(zhǔn)（上）
- 本白皮書主要著眼已經(jīng)得到廣泛采用的PCI 總線的成功優(yōu)勢所在，同時(shí)詳細(xì)介紹下一代高性能I/O 互連技術(shù)PCI Express 它將作為標(biāo)準(zhǔn)的局域I/O 總線被廣泛應(yīng)用于未來各種計(jì)算機(jī)平臺
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FPGA控制CLC5958型A/D轉(zhuǎn)換器高速PCI采集
- 隨著信息技術(shù)的發(fā)展，基于微處理器的數(shù)字信號處理在測控、通訊、雷達(dá)等各個(gè)領(lǐng)域得到廣泛的應(yīng)用。被處理的模擬信號也在向高頻、寬帶方面發(fā)展，但這需要高速、高分辨率的數(shù)字采集卡以將模擬信號數(shù)字化。美國國家半導(dǎo)體公司新推出的系列高速、高分辨率模/數(shù)轉(zhuǎn)換器（如CLC5958）就非常適用于需要高速、高分辨率的信號采集系統(tǒng)。
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基于SOPC的1553B-PCI橋接通信模塊設(shè)計(jì)
- 本文提出了一種基于Altera SOPC技術(shù)的總線橋接通信模塊設(shè)計(jì)方法，完成1553B總線到PCI總線的橋接功能。在Altera FPGA平臺上，自主設(shè)計(jì)了1553B總線控制模塊，由Altera提供的IP核生成PCI總線控制模塊，通過Nios II處理器完成總線數(shù)據(jù)交互。整個(gè)系統(tǒng)僅由一塊FPGA和1553B總線的通信驅(qū)動(dòng)電路組成，實(shí)現(xiàn)了系統(tǒng)的最小化設(shè)計(jì)。
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基于FPGA的實(shí)時(shí)金融指數(shù)行情并行計(jì)算
- 本項(xiàng)目的研究成果除股票交易的并行加速模型與系統(tǒng)設(shè)計(jì)外，還包括對股票交易系統(tǒng)其它業(yè)務(wù)處理的硬件加速論證方案，根據(jù)計(jì)算任務(wù)特點(diǎn)不同，給出合理的硬件加速平臺建設(shè)方案，股票指數(shù)實(shí)時(shí)更新只是其中的一個(gè)應(yīng)用場景。
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PCI EXPRESS兼容性測試簡述
- 2006年10月，100多名工程師來到地處臺北鬧市區(qū)的Westin酒店。他們不是為新游戲機(jī)的發(fā)布，而是為了一件最終對于游戲體驗(yàn)來說更重要的事情。
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CPCI總線在數(shù)字化電臺中的設(shè)計(jì)(圖)
- 隨著現(xiàn)代軍事通信技術(shù)的進(jìn)步，數(shù)字化短波電臺逐步往嵌入式、模塊化的方向發(fā)展。CPCI總線作為一種新興的總線技術(shù)，在短波電臺的模塊化設(shè)計(jì)上具有重要的應(yīng)用價(jià)值，可以較大程度地提高數(shù)字化短波電臺的可靠性和保障性。
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8通道并行數(shù)據(jù)采集PCI模塊的設(shè)計(jì)(圖)
- 數(shù)據(jù)采集是自動(dòng)測試系統(tǒng)的主要功能之一，而在一些應(yīng)用領(lǐng)域，比如超聲、醫(yī)療電子中，信號的頻率范圍不同會(huì)要求采樣率的不同。有時(shí)，為了配合信號處理算法，甚至要求采樣率在一定范圍內(nèi)隨意設(shè)定。而且，這些應(yīng)用通常要求多個(gè)通道并行采集，甚至是差分單端方式可選擇的輸入。針對這些要求，我們提出了一種最多可達(dá)12通道的同步并行多通道數(shù)據(jù)采集方案。該方案能實(shí)現(xiàn)的最高采樣率為10MS/s，存儲深度2×32M×16bit（2個(gè)SDRAM），垂直分辨率14bit，可編程增益為1、2、5、10、100五個(gè)等級。
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基于通用接口芯片CH365的財(cái)稅安全卡設(shè)計(jì)
- 目前中國國內(nèi)“金稅工程”經(jīng)過幾年的推廣實(shí)施，在全國范圍內(nèi)己取得了巨大的經(jīng)濟(jì)效益和社會(huì)效益，在金稅工程中，最重要的是對于開票系統(tǒng)數(shù)據(jù)的保護(hù)，為了防止開票系統(tǒng)受病毒感染或被人為地破壞，絕大部分的單位都被要求專機(jī)專用，從而來確保系統(tǒng)的安全和穩(wěn)定?！ 〉S著“金稅工程”的深入推廣，也暴露出了一些急待解決的問題∶首先，由于國稅局對于企業(yè)的防偽稅控開票系統(tǒng)有“專機(jī)專用”的要求，致使企業(yè)花費(fèi)一萬多元購買的防偽稅控設(shè)備及計(jì)算機(jī)只能用于開具增值稅發(fā)票巨大的資源浪費(fèi);其次，隨著電子報(bào)稅、出口退稅等科技手段在企業(yè)中的應(yīng)用以
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基于USB接口1553B總線設(shè)備檢測系統(tǒng)設(shè)計(jì)
- 引言 MIL-STD-1553B軍用總線標(biāo)準(zhǔn)，在軍事裝備，特別是飛機(jī)系統(tǒng)中得到了廣泛的應(yīng)用，艦載系統(tǒng)中也正在逐步推廣。對于1553B總線傳輸信息的飛機(jī)系統(tǒng)，特別是由該總線網(wǎng)絡(luò)構(gòu)成的綜合航火控系統(tǒng)、通信系統(tǒng)而言，系統(tǒng)時(shí)實(shí)監(jiān)測與在線故障診斷均建立在信息錄取的前提下。為了方便錄取1553B總線上傳輸?shù)男畔⒕托枰獞?yīng)用1553B總線到計(jì)算機(jī)標(biāo)準(zhǔn)接口轉(zhuǎn)換器，目前常用轉(zhuǎn)換器有1553B-PCI、1553B-VXI等，但在工程實(shí)踐過程中，它們存在體積大、價(jià)格高、使用不方便等缺陷。相比而言，USB接口具有體積小、攜帶
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