基于C64x+ DSP高速緩存一致性分析與維護
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數(shù)據(jù)CACHE一致性
對于數(shù)據(jù)部分的一致性維護，需要由軟件維護的情況是6)，包括內核對DDR2的讀取和寫兩種情況。圖 9和圖 10分別描述了這兩種情況。
圖 9 內核對DDR2上的數(shù)據(jù)讀的情況
圖 10 內核對DDR2上的數(shù)據(jù)寫的情況
本文小結
高速緩存一致性問題是DSP應用中常見的問題，TI C64x+ DSP是業(yè)界高性能信號處理平臺，具有優(yōu)良的高速緩存性能。C64x+平臺上高速緩存一致性問題維護可以歸納為以下兩點：1) 代碼部分的一致性問題需要由軟件來維護；2) 只有當內核和其它主機共同需要訪問的數(shù)據(jù)緩沖區(qū)在外部存儲器中的時候，數(shù)據(jù)高速緩存一致性問題才需要由軟件來進行維護。其它情況下，數(shù)據(jù)高速緩存一致性都會由硬件自動完成。
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