基于NoisⅡ的程控數(shù)字信號源設計
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1．2 AD9854信號產生單元
AD9854的DDS核具有48位的頻率分辨率。輸出的信號頻率最高達150 MHz、頻率分辨率可達1μHz。將AD9854的8位數(shù)據(jù)線、5位地址線以及一些控制信號線(復位、寄存器數(shù)據(jù)更新引腳、FSK引腳等)引出連接到FPGA的通用I／O口上，使得FPGA可以完成對AD9854的相關配置與控制。AD9854的時鐘輸入采用了差分時鐘輸入形式。
1．3 人機交互界面
本單元由液晶顯示單元和PS／2鍵盤輸入單元組成。液晶單元采用ILI9320片上系統(tǒng)(SoC)驅動器。有18位數(shù)據(jù)線，采用了16 b總線寬度的i80-systemMPU接口，PWM為液晶背光亮度調節(jié)引腳；RS為寄存器選擇信號，低電平選擇索引或狀態(tài)寄存器，高電平選擇控制寄存器；
為芯片片選信號，低電平使能；
為讀選通信號，低電平時讀出數(shù)據(jù)；
為寫選通信號，低電平時寫入寄存器數(shù)據(jù)。PS／2是一種雙向同步串行通信協(xié)議，通過Clock時鐘數(shù)據(jù)同步被讀入。2 系統(tǒng)軟件設計
NoisⅡ軟核CPU是整個系統(tǒng)的控制部分，集成在FPGA內部，由SoPC Builder定制。將需要的IP組合在一起，設定各組件的地址和中斷優(yōu)先級，各IP Core通過Avalon總線邏輯互連，自由配置處理器的CACHE大小、指令集ROM大小、片內RAM和ROM大小、I／O引腳數(shù)目和類型、中斷引腳數(shù)目、定時器數(shù)目、通用串口數(shù)目、擴展地址和數(shù)據(jù)引腳等處理器的性能指標。NoisⅡ集成開發(fā)環(huán)境提供了創(chuàng)建C／C++應用工程的向導、管理和編譯工程功能、運行和調試程序功能和最終程序的FLASH的燒寫。編程采用C語言。
系統(tǒng)首先進行初始值，然后顯示開機系統(tǒng)界面，軟核CPU接收到鍵盤中斷輸入的顯示信號和向AD9854輸出指令后，啟動顯示和輸出程序模塊，使AD9854產生響應的信號輸出。對設置數(shù)據(jù)進行存儲防止設置信息掉電丟失。整體程序設計流程如圖3所示。
2．1 AD9854驅動程序
(1)AD9854主要負責各種波形信號的產生，采用并行模式，其程序框圖如圖4所示。本文引用地址：http://yuyingmama.com.cn/article/190480.htm
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