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          isp ip 文章 最新資訊

          TCP/IP遠(yuǎn)程網(wǎng)絡(luò)步進(jìn)電機(jī)控制器

          基于FPGA的UPFC控制器IP設(shè)計(jì)

          •  0 引言   統(tǒng)一潮流控制器(Unified Power Flow Con-troller,簡(jiǎn)稱UPFC)是一種可以較大范圍地控制電流使之按指定路經(jīng)流動(dòng)的設(shè)備,它可在保證輸電線輸送容量接近熱穩(wěn)定極限的同時(shí)又不至于過負(fù)荷。控制系統(tǒng)是UPFC的核
          • 關(guān)鍵字: IP  設(shè)計(jì)  控制器  UPFC  FPGA  基于  

          IP承載網(wǎng)絡(luò)規(guī)劃設(shè)計(jì)探討

          • 毋庸置疑,現(xiàn)代通信網(wǎng)絡(luò)的發(fā)展,是由業(yè)務(wù)需求和市場(chǎng)需求來決定的,而不是技術(shù)的發(fā)展。我們回頭看看互聯(lián)網(wǎng)(IP網(wǎng)絡(luò))的發(fā)展歷程,這其中市場(chǎng)推動(dòng)的痕跡非常明顯:這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡(luò)技術(shù),在九十年代
          • 關(guān)鍵字: 探討  規(guī)劃設(shè)計(jì)  網(wǎng)絡(luò)  承載  IP  

          基于Nios II處理器的SVPWM IP Core設(shè)計(jì)

          • 摘要 為降低FPGA實(shí)現(xiàn)3電平SVPWM算法的復(fù)雜性,減小SVPWM模塊所占用的資源,文中利用正弦函數(shù)和余弦函數(shù)的關(guān)系,采用小容量ROM提出了一種新的SVPWM控制算法。利用Verilog HDL實(shí)現(xiàn)了算法的硬件設(shè)計(jì),并封裝成IP核以方便
          • 關(guān)鍵字: SVPWM  Nios  Core  IP    

          基于Nios II步進(jìn)電機(jī)控制器IP核的設(shè)計(jì)與實(shí)現(xiàn)

          • 摘要 根據(jù)Nios II處理器的Avalon總線規(guī)范,設(shè)計(jì)了一款面向步進(jìn)電機(jī)的控制器IP核。該定制IP核采用軟、硬件協(xié)同設(shè)計(jì)的方法,功能符合Avalon總線的讀寫傳輸時(shí)序,具有完備的步進(jìn)電機(jī)驅(qū)動(dòng)能力。仿真結(jié)果表明,該IP核具有
          • 關(guān)鍵字: IP  設(shè)計(jì)  實(shí)現(xiàn)  控制器  電機(jī)  Nios  II  步進(jìn)  基于  

          IP承載網(wǎng)絡(luò)規(guī)劃設(shè)計(jì)分析

          • 毋庸置疑,現(xiàn)代通信網(wǎng)絡(luò)的發(fā)展,是由業(yè)務(wù)需求和市場(chǎng)需求來決定的,而不是技術(shù)的發(fā)展。我們回頭看看互聯(lián)網(wǎng)(IP網(wǎng)絡(luò))的發(fā)展歷程,這其中市場(chǎng)推動(dòng)的痕跡非常明顯:這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡(luò)技術(shù),在九十年代
          • 關(guān)鍵字: 分析  規(guī)劃設(shè)計(jì)  網(wǎng)絡(luò)  承載  IP  

          SM2965微控制器及其ISP應(yīng)用技術(shù)

          • “在系統(tǒng)編程”(In-SystemProgramming,簡(jiǎn)稱ISP)技術(shù)的出現(xiàn)是對(duì)傳統(tǒng)編程方法的重大突破,它是指在用戶設(shè)計(jì)的微控制器系統(tǒng)中為配置新的系統(tǒng)功能而對(duì)器件進(jìn)行重新編程,并在線地將程序代碼(固件)下載到
          • 關(guān)鍵字: 應(yīng)用技術(shù)  ISP  及其  控制器  SM2965  

          ATM網(wǎng)絡(luò)與IP兼容技術(shù)介紹

          • ATM可以提供空前的可伸縮性和性價(jià)比,以及對(duì)將來的實(shí)時(shí)業(yè)務(wù)、多媒體業(yè)務(wù)等的支持,ATM將扮演重要的角色。但目前的信息體系,即LAN和WAN,建立在網(wǎng)絡(luò)層協(xié)議如IP、IPX、AppleTalk等的基礎(chǔ)上,因此,ATM的成功及Internet
          • 關(guān)鍵字: 技術(shù)  介紹  兼容  IP  網(wǎng)絡(luò)  ATM  

          基于IP復(fù)用和SOC技術(shù)的微處理器FSPLCSOC模塊設(shè)計(jì)

          • 基于IP復(fù)用和SOC技術(shù)的微處理器FSPLCSOC模塊設(shè)計(jì),1 引言   文中采用IP核復(fù)用方法和SOC技術(shù)基于AVR 8位微處理器AT90S1200IP Core設(shè)計(jì)專用PLC微處理器FSPLCSOC模塊。隨著芯片集成程度的飛速提高,IC產(chǎn)業(yè)中形成了以片上系統(tǒng)SOC(System-on-Chip)技術(shù)為主的設(shè)計(jì)方式。一
          • 關(guān)鍵字: FSPLCSOC  模塊  設(shè)計(jì)  微處理器  技術(shù)  IP  復(fù)用  SOC  基于  

          MCU&USB設(shè)備控制器IP核的設(shè)計(jì)

          • MCUUSB設(shè)備控制器IP核的設(shè)計(jì),摘要:用硬件描述語言verilog HDL設(shè)計(jì)實(shí)現(xiàn)了一種MCUUSB設(shè)備控制器IP核。論文首先簡(jiǎn)要介紹了設(shè)計(jì)的背景,重點(diǎn)對(duì)自主研發(fā)的將MCUUSB控制器集成于一個(gè)芯片的設(shè)計(jì)和研究分析。最后給出nc-verilog功能仿真方案以及FPGA驗(yàn)
          • 關(guān)鍵字: 設(shè)計(jì)  IP  控制器  設(shè)備  MCU&USB  

          基于ISP微控制器的PLC實(shí)現(xiàn)方法

          • 可編程序控制器(Programmable Logic Controller,簡(jiǎn)稱PLC)把自動(dòng)化技術(shù)、計(jì)算機(jī)技術(shù)和通信技術(shù)融為一體,按照成熟而有效的繼電控制概念和設(shè)計(jì)思想,用先進(jìn)的微控制器技術(shù)來實(shí)現(xiàn)I/O的實(shí)時(shí)檢測(cè)和控制。由于PLC具有編
          • 關(guān)鍵字: 實(shí)現(xiàn)  方法  PLC  控制器  ISP  基于  

          基于RlTOS和ISP功能數(shù)字儀表系統(tǒng)設(shè)計(jì)實(shí)現(xiàn)

          • 摘要:以Atmel公司的AT89S52 型單片微控制器為對(duì)象,介紹基于RTOS(多任務(wù)實(shí)時(shí)操作系統(tǒng))和ISP(在系統(tǒng)可編程)功能 ...
          • 關(guān)鍵字: RTOS  ISP  單片微控制器  液晶顯示模塊  

          嵌入式微處理器IP core設(shè)計(jì)與分析

          • 嵌入式微處理器IP core設(shè)計(jì)與分析,摘要:本文在對(duì)傳統(tǒng)微控制器進(jìn)行系統(tǒng)分析的基礎(chǔ)上,提出了一種較好的改進(jìn)設(shè)計(jì)方法?;乇芰藗鹘y(tǒng)微控制器基于累加器的ALU結(jié)構(gòu)及算術(shù)邏輯指令:并在指令執(zhí)行時(shí)序上盡量減少指令執(zhí)行所需的時(shí)鐘周期。通過仿真驗(yàn)證證明該設(shè)
          • 關(guān)鍵字: 設(shè)計(jì)  分析  core  IP  微處理器  嵌入式  

          一種支持ISP的Flash在嵌入式設(shè)計(jì)中的應(yīng)用

          • 一種支持ISP的Flash在嵌入式設(shè)計(jì)中的應(yīng)用,引言在基于VxWorks的嵌入式系統(tǒng)開發(fā)過程中,板卡支持包BSP(Board Support Package)的開發(fā)是非常重要而又閑難的一個(gè)環(huán)節(jié)。因?yàn)椴荒艽_定硬件系統(tǒng)是否正常丁作,而后續(xù)應(yīng)用開發(fā)都是以此為基礎(chǔ)。在實(shí)際開發(fā)中,為了提高開
          • 關(guān)鍵字: 設(shè)計(jì)  應(yīng)用  嵌入式  Flash  ISP  支持  

          基于嵌入式Linux的TFT LCD IP及驅(qū)動(dòng)的設(shè)計(jì)

          • 系統(tǒng)總體設(shè)計(jì)方案本系統(tǒng)的總體設(shè)計(jì)框圖如圖1所示。
            圖1 系統(tǒng)框圖

            Nios II處理器在SDRAM中開辟幀緩沖(Frame buffer),可以是單緩沖也可以是雙緩沖。以單緩沖為例。處理器將一幀圖像數(shù)據(jù)(640times;480times;2Byt
          • 關(guān)鍵字: IP  驅(qū)動(dòng)  設(shè)計(jì)  LCD  TFT  嵌入式  Linux  基于  
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          isp ip介紹

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