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DVB-C解交織器的FPGA實現(xiàn)
- 卷積交織和解交織原理簡介 在DVB-C系統(tǒng)當中，實際信道中的突發(fā)錯誤往往是由脈沖干擾、多徑衰落引起的，在統(tǒng)計上是相關(guān)的，所以一旦出現(xiàn)不能糾正的錯誤時，這種錯誤將連續(xù)存在。因此在DVB-C系統(tǒng)里，采用了卷積交織來解決這種問題。它以一定規(guī)律擾亂源符號數(shù)據(jù)的時間順序，使其相關(guān)性減弱，然后將其送入信道，解交織器按相反規(guī)律恢復(fù)出源符號數(shù)據(jù)。 DVB-C的卷積交織和解交織原理為：交織由I=12(I為交織深度)個分支構(gòu)成。每個分支的延時逐漸遞增，遞增的單元數(shù)M=n/I=204/12=17(M為交織基數(shù))。這里的
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PCB繪圖總結(jié)
- 1，布局/布線，對電氣性能的影響經(jīng)常都會從有關(guān)電子的書中看到這樣的說法“數(shù)字地線與模擬地線要分開”。布過板的人都知道，這在實際操作上有一定的難度。 要布出更好的板，首先您得對您所使用的IC有個電氣方面的了解，有哪些引腳會產(chǎn)生高次諧波（數(shù)字信號或開關(guān)量方波信號的上升/下降沿），哪些引腳易感應(yīng)電磁于擾，IC內(nèi)部的信號方框圖（信號處理單元方塊圖）有助我們的了解。 整機布局是決定電氣性能的首要條件，而板間的布局更多的考慮是IC間的信號/數(shù)據(jù)的走向或流程，大原則是易產(chǎn)生電磁幅射的靠近電源部分；弱信號處
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PCB設(shè)計的一些小事情(1)
- 雞毛蒜皮之一：成本節(jié)約 現(xiàn)象一：這些拉高/拉低的電阻用多大的阻值關(guān)系不大，就選個整數(shù)5K吧 點評：市場上不存在5K的阻值，最接近的是4.99K（精度1%），其次是5.1K（精度5%），其成本分別比精度為20%的4.7K高4倍和2倍。20%精度的電阻阻值只有1、1.5、2.2、3.3、4.7、6.8幾個類別（含10的整數(shù)倍）；類似地，20%精度的電容也只有以上幾種值，如果選了其它的值就必須使用更高的精度，成本就翻了幾倍，卻不能帶來任何好處。 現(xiàn)象二：面板上
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PCB設(shè)計的一些小事情(2)
- 膠片尺寸收縮原因分析 今日電路板對尺寸穩(wěn)定性要求須達到每24IN變化不超過1MIL的精度，甚至每30IN不超過0．5MIL為標準，因此，線路版廠在溫濕度控制方面就必須嚴格控制，特別每逢冬天，誰都有膠片收縮方面的煩惱，導(dǎo)致膠片頻頻更換，甚至內(nèi)層板報廢嚴重！作為流程工程師，在控制好環(huán)境濕度的同時，可以注意以下幾個方面的原因，對于不能改善的項目，可以抓住它的收縮規(guī)律，在CAM時給予補償！ 1，膠片在光繪前沒有經(jīng)過預(yù)置 由于膠片制造時無法預(yù)先控制膠片中的濕度與每個生
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業(yè)余條件下制作電路板方法總覽
- 前言 電路板是電子電路的載體，任何的電路設(shè)計都需要被安裝在一塊電路板上，才可以實現(xiàn)其功能。而加工電路板，又是業(yè)余電子愛好者感到最頭痛的事，往往是：半天時間就設(shè)計好的電路，可加工電路板卻花費了幾天的時間。甚至一些很好的電路設(shè)計創(chuàng)意，卻因為加工電路板太花時間而放棄了實驗，無法繼續(xù)實現(xiàn)。站長20多年前就開始搞電路實驗，最暈菜的也是做電路板，可謂是想盡了一切辦法：油漆、石蠟、復(fù)寫紙、雕刻刀，甚至MM們用的指甲油、眉筆什么的東東都用上了，都還是不能達到高效、高質(zhì)制作實驗電路板的目的。 后來到公司搞專業(yè)設(shè)
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高速PCB設(shè)計入門概念問答集
- 高速PCB設(shè)計入門概念問答集 要做高速的PCB設(shè)計，首先必須明白下面的一些基本概念，這是基礎(chǔ)。 1、什么是電磁干擾（EMI）和電磁兼容性(EMC)? (Electromagnetic Interference)，有傳導(dǎo)干擾和輻射干擾兩種。 傳導(dǎo)干擾是指通過導(dǎo)電介質(zhì)把一個電網(wǎng)絡(luò)上的信號耦合（干擾）到另一個電網(wǎng)絡(luò)。輻射干擾是指干擾源通過空間把其信號耦合（干擾）到另一個電網(wǎng)絡(luò)。在高速PCB及系統(tǒng)設(shè)計中，高頻信號線、集成電路的引腳、各類接插件等都可能成為具有天線特性的輻射干擾源，能發(fā)射電磁波并
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PCB設(shè)計流程（新手必讀）
- 一般PCB基本設(shè)計流程如下：前期準備->PCB結(jié)構(gòu)設(shè)計->PCB布局->布線->布線優(yōu)化和絲印->網(wǎng)絡(luò)和DRC檢查和結(jié)構(gòu)檢查->制版。 第一：前期準備。這包括準備元件庫和原理圖?！肮び破涫?，必先利其器”，要做出一塊好的板子，除了要設(shè)計好原理之外，還要畫得好。在進行PCB設(shè)計之前，首先要準備好原理圖SCH的元件庫和PCB的元件庫。 元件庫可以用peotel 自帶的庫，但一般情況下很難找到合適的，最好是自己根據(jù)所選器件的標準尺寸資料自己做元件庫。原
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FPGA迎來65nm時代
- 11月13日，Altera公司正式發(fā)布了業(yè)界期盼以久的65nm FPGA—Stratix III 。與此同時Xilinx又更進一步，在同一時間推出了65nm的Virtex-5 LXT系列，這也是時隔半年之后Xilinx推出的第二款65nm 產(chǎn)品。由此，F(xiàn)PGA進入了65nm時代，Altera 與Xilinx也將展開新的技術(shù)對壘。 Altera: Stratix III FPGA怎樣在獲得高性能的同時保持低功耗是65nm領(lǐng)域的最大難題，Altera的解決辦法是針對設(shè)計中需要的地方提高性能，而把其他地方的功
- 關(guān)鍵字： 0612_A FPGA 單片機 嵌入式系統(tǒng) 雜志_業(yè)界風云
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