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基于FPGA的可編程定時(shí)器/計(jì)數(shù)器8253的設(shè)計(jì)與實(shí)現(xiàn)

摘要：本文介紹了可編程定時(shí)器/計(jì)數(shù)器8253的基本功能，以及一種用VHDL語(yǔ)言設(shè)計(jì)可編程定時(shí)器/計(jì)數(shù)器8253的方法，詳述了其原理和設(shè)計(jì)思想，并利用Altera公司的FPGA器件ACEX 1K予以實(shí)現(xiàn)。關(guān)鍵詞：FPGA；IP；VHDL 引言在工程上及控制系統(tǒng)中，常常要求有一些實(shí)時(shí)時(shí)鐘，以實(shí)現(xiàn)定時(shí)或延時(shí)控制，如定時(shí)中斷，定時(shí)檢測(cè)，定時(shí)掃描等，還要求有計(jì)數(shù)器能對(duì)外部事件計(jì)數(shù)。要實(shí)現(xiàn)定時(shí)或延時(shí)控制，有三種主要方法：軟件定時(shí)、不可編程的硬件定時(shí)、可編程的硬件定時(shí)器。其中可編
關(guān)鍵字： FPGA IP VHDL

低壓閃光燈方案

摘要：本文介紹了手機(jī)和數(shù)碼相機(jī)用低壓閃光燈方案、主要器件，以及設(shè)計(jì)選用要求。關(guān)鍵詞：低壓閃光燈；Flash LED；電荷泵各種相機(jī)內(nèi)置或外加的萬(wàn)次閃光燈，多數(shù)都是通過(guò)振蕩和變壓器升壓，經(jīng)電容器儲(chǔ)存能量，在需要的瞬間釋放并感應(yīng)出高壓，激發(fā)惰性氣體發(fā)出脈沖光，從而獲得極強(qiáng)的瞬時(shí)功率。以高亮度LED為閃光燈源的低壓閃光燈的出現(xiàn)，給傳統(tǒng)的閃光燈帶來(lái)了革命性的變化。低壓閃光燈不需要振蕩電路，不需要升壓變壓器和儲(chǔ)能大電容器，F(xiàn)lash LED只需要3.5~4.5V的直流電壓、
關(guān)鍵字： Flash LED 低壓閃光燈電荷泵發(fā)光二極管 LED

256級(jí)灰度LED點(diǎn)陣屏顯示原理及基于FPGA的電路設(shè)計(jì)

摘要：本文提出了一種LED點(diǎn)陣屏實(shí)現(xiàn)256級(jí)灰度顯示的新方法。詳細(xì)分析了其工作原理。并依據(jù)其原理，設(shè)計(jì)出了基于FPGA 的控制電路。關(guān)鍵詞：256級(jí)灰度；LED點(diǎn)陣屏；FPGA；電路設(shè)計(jì) 引言256級(jí)灰度LED點(diǎn)陣屏在很多領(lǐng)域越來(lái)越顯示出其廣闊的應(yīng)用前景，本文提出一種新的控制方式，即逐位分時(shí)控制方式。隨著大規(guī)?？删幊踢壿嬈骷某霈F(xiàn)，由純硬件完成的高速、復(fù)雜控制成為可能。逐位分時(shí)點(diǎn)亮工作原理所謂逐位分時(shí)點(diǎn)亮，即從一個(gè)字節(jié)數(shù)據(jù)中依次提取出一位數(shù)據(jù)，分8次點(diǎn)亮對(duì)應(yīng)的像
關(guān)鍵字： 256級(jí)灰度 FPGA LED點(diǎn)陣屏電路設(shè)計(jì) 發(fā)光二極管 LED

一種高效的復(fù)信號(hào)處理芯片設(shè)計(jì)

摘要：本文提出了一種高效的復(fù)信號(hào)處理芯片的設(shè)計(jì)方法。本芯片是某雷達(dá)信號(hào)處理機(jī)的一部分，接收3組ADC的輸出復(fù)數(shù)據(jù)，依次完成去直流、加窗、512點(diǎn)FFT、求功率譜和累加3組信號(hào)的功率譜等功能。在這5種功能中，加窗、512點(diǎn)FFT和求功率譜復(fù)用一個(gè)蝶形單元。本芯片由單片F(xiàn)PGA實(shí)現(xiàn)，計(jì)算精度高、速度較快，滿(mǎn)足雷達(dá)系統(tǒng)的實(shí)時(shí)處理要求。關(guān)鍵詞： FFT；蝶形單元；塊浮點(diǎn)；功率譜； FPGA 引言復(fù)信號(hào)處理芯片是某雷達(dá)系統(tǒng)的一部分。雷達(dá)系統(tǒng)的實(shí)時(shí)處理特點(diǎn)要求芯片運(yùn)
關(guān)鍵字： FFT FPGA 蝶形單元功率譜塊浮點(diǎn)

采用FPGA實(shí)現(xiàn)脈動(dòng)陣列

微電子學(xué)的發(fā)展徹底改變了計(jì)算機(jī)的設(shè)計(jì)：集成電路技術(shù)增加了能夠安裝到單個(gè)芯片中的元器件數(shù)目及其復(fù)雜度。因此，采用這種技術(shù)可以構(gòu)建低成本、專(zhuān)用的外圍器件，從而迅速地解決復(fù)雜的問(wèn)題。
關(guān)鍵字： FPGA 脈動(dòng) 陣列

基于AD9430的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

摘要：本文介紹了高速ADC AD9430的功能，詳細(xì)說(shuō)明了使用高速FPGA來(lái)控制AD9430構(gòu)成高速(140MSPS)、高精度(12位)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方法，并給出了具體實(shí)現(xiàn)的系統(tǒng)框圖和測(cè)試結(jié)果。關(guān)鍵詞：數(shù)據(jù)采集；FPGA；AD9430引言結(jié)合實(shí)際任務(wù)的要求，本文提出了一種基于AD9430的高速數(shù)據(jù)采集系統(tǒng)，主要用于采集雷達(dá)回波。在這個(gè)系統(tǒng)中，選用高速邏輯器件控制A/D轉(zhuǎn)換和FIFO存儲(chǔ)，同時(shí)通過(guò)FPDP(Front Panel Data Port)總線(xiàn)將采集的數(shù)據(jù)發(fā)送出去。由
關(guān)鍵字： AD9430 FPGA 數(shù)據(jù)采集

基于FPGA的非對(duì)稱(chēng)同步FIFO設(shè)計(jì)

摘要：本文在分析了非對(duì)稱(chēng)同步FIFO的結(jié)構(gòu)特點(diǎn)及其設(shè)計(jì)難點(diǎn)的基礎(chǔ)上，采用VHDL描述語(yǔ)言，并結(jié)合FPGA，實(shí)現(xiàn)了一種非對(duì)稱(chēng)同步FIFO的設(shè)計(jì)。關(guān)鍵詞：非對(duì)稱(chēng)同步FIFO；VHDL；FPGA；DLL；BlockRAM引言FIFO是一種常用于數(shù)據(jù)緩存的電路器件，可應(yīng)用于包括高速數(shù)據(jù)采集、多處理器接口和通信中的高速緩沖等各種領(lǐng)域。然而在某些應(yīng)用，例如在某數(shù)據(jù)采集和處理系統(tǒng)中，需要通過(guò)同步FIFO來(lái)連接8位A/D和16位數(shù)據(jù)總線(xiàn)的MCU，但是由于目前同步FIFO器件的輸入與輸
關(guān)鍵字： BlockRAM DLL FPGA VHDL 非對(duì)稱(chēng)同步FIFO 存儲(chǔ)器

基于FPGA的高速數(shù)字鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)

摘要：本文提出了一種利用邊沿觸發(fā)鑒相縮短鎖相環(huán)捕獲時(shí)間的方案，并詳細(xì)介紹了該方案基于FPGA的實(shí)現(xiàn)方法。通過(guò)對(duì)所設(shè)計(jì)的鎖相環(huán)進(jìn)行計(jì)算機(jī)仿真和硬件測(cè)試，表明該方案確實(shí)可以提高鎖相環(huán)的捕獲性能。關(guān)鍵詞：數(shù)字鎖相環(huán)(DPLL)；捕獲時(shí)間；FPGA；VHDL引言捕獲時(shí)間是鎖相環(huán)的一個(gè)重要參數(shù)，指的是鎖相環(huán)從起始狀態(tài)到達(dá)鎖定狀態(tài)所需時(shí)間。在一些系統(tǒng)中，如跳頻通信系統(tǒng)，由于系統(tǒng)工作頻率不斷地發(fā)生快速變化(每秒幾百次到幾千次，甚至高達(dá)上萬(wàn)次)，要求鎖相環(huán)能夠?qū)π盘?hào)相位快速捕獲。因此
關(guān)鍵字： FPGA VHDL 捕獲時(shí)間數(shù)字鎖相環(huán)(DPLL)

基于CC/CCS的Flash文件系統(tǒng)設(shè)計(jì)

在深入分析TI為開(kāi)發(fā)DSP提供的RTS.LIB(RTS.SRC為源泉代碼)的基礎(chǔ)上，介紹對(duì)自定義的文件和設(shè)備的操作方法；設(shè)計(jì)一個(gè)簡(jiǎn)易的Flash文件系統(tǒng)，極大地方便了應(yīng)用編程。
關(guān)鍵字：系統(tǒng) 設(shè)計(jì) 文件 Flash CC/CCS 基于

大容量NAND Flash TC58DVG02A1FT00在嵌入式系統(tǒng)中

隨著嵌入式系統(tǒng)產(chǎn)品的發(fā)展，對(duì)存儲(chǔ)設(shè)備的要求也日益增強(qiáng)。文章以東芝的NAND E2PROM器件TC58DVG02A1F00為例，闡述了NAND Flash的基本結(jié)構(gòu)和使用方法
關(guān)鍵字： Flash NAND 02A 1FT

TMS320C6711的FLASH引導(dǎo)裝載系統(tǒng)研究與設(shè)計(jì)

引導(dǎo)裝載是DSP系統(tǒng)設(shè)計(jì)中必不可少的重要環(huán)節(jié)。文章對(duì)TI公司TMS320C6711中FLASH引導(dǎo)裝載的概念、方法及特點(diǎn)做了詳細(xì)闡述，同時(shí)以SST公司的FLASH器（SST39VF040）為例，設(shè)計(jì)了一個(gè)利用FLASH進(jìn)行引導(dǎo)裝載的系統(tǒng)方案，并給出相應(yīng)的自加載程序源代碼。
關(guān)鍵字：研究設(shè)計(jì) 系統(tǒng) 裝載 FLASH 引導(dǎo) TMS320C6711

集系統(tǒng)級(jí)FPGA芯片XCV50E的結(jié)構(gòu)與開(kāi)發(fā)

VirtexE系列是XILINX公司生產(chǎn)的新型FPGA芯片，可用來(lái)進(jìn)行數(shù)十萬(wàn)邏輯門(mén)級(jí)的系統(tǒng)設(shè)計(jì)和百兆赫茲級(jí)的高速電路設(shè)計(jì)。
關(guān)鍵字： FPGA 50E XCV 50

基于FPGA的光柵尺信號(hào)智能接口模塊

介紹了一種基于ALTERA公司大規(guī)?？删幊踢壿嬈骷﨓PF10K10的多功能光柵尺處理品電路。敘述了該電路的主要電路――四倍頻細(xì)分、辨向電路、計(jì)數(shù)電路、接口處理電路的設(shè)計(jì)原理，風(fēng)時(shí)給出了詳細(xì)的電路和仿真波形。
關(guān)鍵字： FPGA 光柵信號(hào) 模塊

基于FPGA的同步測(cè)周期高精度數(shù)字頻率計(jì)的設(shè)計(jì)

摘要：本文介紹了一種同步測(cè)周期計(jì)數(shù)器的設(shè)計(jì)，并基于該計(jì)數(shù)器設(shè)計(jì)了一個(gè)高精度的數(shù)字頻率計(jì)。文中給出了計(jì)數(shù)器的VHDL編碼，并對(duì)頻率計(jì)的FPGA實(shí)現(xiàn)進(jìn)行了仿真驗(yàn)證，給出了測(cè)試結(jié)果。關(guān)鍵詞：頻率計(jì)；VHDL；FPGA；周期測(cè)量在現(xiàn)代數(shù)字電路設(shè)計(jì)中，采用FPGA結(jié)合硬件描述語(yǔ)言VHDL可以設(shè)計(jì)出各種復(fù)雜的時(shí)序和邏輯電路，具有設(shè)計(jì)靈活、可編程、高性能等優(yōu)點(diǎn)。本文將介紹一種基于FPGA，采用同步測(cè)周期的方法來(lái)實(shí)現(xiàn)寬頻段高精度數(shù)字頻率計(jì)的設(shè)計(jì)。圖1 同步測(cè)周期計(jì)數(shù)器
關(guān)鍵字： FPGA VHDL 頻率計(jì) 周期測(cè)量

手機(jī)相機(jī)的低壓閃光燈設(shè)計(jì)

摘要：本文介紹了手機(jī)相機(jī)用低壓閃光燈電路設(shè)計(jì)，及主要器件的選用要求。關(guān)鍵詞：低壓閃光燈；Flash LED；電荷泵手機(jī)的周邊設(shè)計(jì)是增加手機(jī)附加功能、賣(mài)點(diǎn)和新利潤(rùn)的主要方法。每年推出的數(shù)百種新款手機(jī)，無(wú)非是改變或增加了手機(jī)的外觀形狀和顏色、鍵盤(pán)燈和顯示屏的顏色和亮度、聲音重現(xiàn)的方式和質(zhì)量、鈴聲和弦的變化、拍照、上網(wǎng)、接收電視和電臺(tái)以及播放MP3的功能等等。手機(jī)增加拍照功能幾乎成了手機(jī)新設(shè)計(jì)方案的必然趨勢(shì)，目前市場(chǎng)上的手機(jī)相機(jī)大多是選用30萬(wàn)像素VGA格式的CMOS鏡頭，
關(guān)鍵字： Flash LED 低壓閃光燈電荷泵發(fā)光二極管 LED