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Xilinx UltraScale 架構(gòu)—業(yè)界首款A(yù)SIC級(jí)All Programmable架構(gòu)
- 現(xiàn)在，人們需要采用一種創(chuàng)新型架構(gòu)來管理數(shù)百Gbps的系統(tǒng)性能，以實(shí)現(xiàn)全線速下的智能處理能力，并擴(kuò)展至Tb級(jí)性能和每秒10億次浮點(diǎn)運(yùn)算水平。
- 關(guān)鍵字： 賽靈思 DSP ASIC UltraScale RAM
常見問題解答：賽靈思采用首個(gè)ASIC級(jí)UltraScale可
- 1. 賽靈思將在2013年7月10日宣布推出什么產(chǎn)品？ 賽靈思宣布20nm兩項(xiàng)新的行業(yè)第一，延續(xù)28nm工藝節(jié)點(diǎn)上一系列業(yè)界創(chuàng)新優(yōu)勢(shì)： middot; 賽靈思宣布開始投片半導(dǎo)體行業(yè)首款20nm器件以及投片PLD行業(yè)首款20nm All
- 關(guān)鍵字： UltraScale ASIC 賽靈思 可編程
ASIC設(shè)計(jì)服務(wù)何去何從？高端應(yīng)用和中國客戶是兩大關(guān)鍵詞
- “Is ASIC dead ?”這是剛剛落下帷幕的2013“深圳(國際)集成電路創(chuàng)新與應(yīng)用展”(China IC Expo，簡(jiǎn)稱CICE)上業(yè)界熱議的一個(gè)話題。的確，現(xiàn)如今FPGA越來越“強(qiáng)勢(shì)”，越來越多地將ARM核、MCU、DSP等融合進(jìn)來，在性能和功耗上對(duì)ASIC進(jìn)行全面圍堵。不只如此，當(dāng)硅制造技術(shù)進(jìn)入到28nm甚至更低節(jié)點(diǎn)時(shí)，芯片制造動(dòng)輒上百萬美金的NRE費(fèi)用也讓系統(tǒng)設(shè)計(jì)公司吃不消。
- 關(guān)鍵字： 富士通 ASIC FPGA
安森美與空客合作開發(fā)飛行控制計(jì)算機(jī)的復(fù)雜ASIC
- 推動(dòng)高能效創(chuàng)新的安森美半導(dǎo)體(ON Semiconductor，美國納斯達(dá)克上市代號(hào)：ONNN)與領(lǐng)先的飛機(jī)制造商空中客車(簡(jiǎn)稱“空客”)完成合作開發(fā)及投產(chǎn)一款復(fù)雜的專用集成電路(ASIC)，應(yīng)用于空客A350 XWB寬體飛機(jī)的飛行控制計(jì)算機(jī)。這定制硅方案的代號(hào)為JEKYLL，使用了安森美半導(dǎo)體內(nèi)部的110納米(nm)工藝技術(shù)，在安森美半導(dǎo)體美國俄勒岡州的Gresham工廠制造。
- 關(guān)鍵字： 安森美 半導(dǎo)體 D0-254 ASIC
HDB3編碼器ASIC的設(shè)計(jì)
- 在數(shù)字通信領(lǐng)域中，HDB3碼是一種非常適合在基帶信號(hào)傳輸系統(tǒng)中傳輸?shù)拇a型，并保持了AMI的優(yōu)點(diǎn)。為了滿足用戶的需求，提高通信系統(tǒng)工作穩(wěn)定性，HDB3編碼器專用集成電路(ASIC)集成了插“V”、插“B”和“V”碼極性糾正模塊，通過仿真和硬件驗(yàn)證，它可以有效消除傳輸信號(hào)中的直流成分和很小的低頻成分，可以實(shí)現(xiàn)基帶信號(hào)在基帶信道中直接傳輸與提取，同時(shí)能很好地提取定時(shí)信號(hào)。
- 關(guān)鍵字： 設(shè)計(jì) ASIC 編碼器 HDB3
AMD成立半訂制業(yè)務(wù)部門 搶客制化ASIC市場(chǎng)
- 美商超微(AMD)宣布正式成立半訂制業(yè)務(wù)部門(Semi-CustomBusinessUnit，SCBU)，基于超微在中央處理器、繪圖芯片核心、多媒體等領(lǐng)域龐大的知識(shí)產(chǎn)權(quán)(IP)，將針對(duì)客戶需求訂制專屬的特殊應(yīng)用芯片(ASIC)。 AMD已經(jīng)拿下索尼PS4、微軟Xbox720等新款游戲機(jī)ASIC訂單，未來也將搶進(jìn)智能電視及機(jī)頂盒等市場(chǎng)，對(duì)于國內(nèi)設(shè)計(jì)服務(wù)及ASIC廠來說，將帶來不小的競(jìng)爭(zhēng)壓力。 AMD早在一年多前就已公開討論進(jìn)入ASIC市場(chǎng)的策略理念，SCBU部門在去年底就已經(jīng)組成，而超微現(xiàn)在
- 關(guān)鍵字： AMD 處理器 ASIC
Tensilica與華為為下一代產(chǎn)品深化戰(zhàn)略合作伙伴關(guān)系
- Tensilica日前宣布與華為加強(qiáng)戰(zhàn)略合作伙伴關(guān)系。海思半導(dǎo)體 - 華為的半導(dǎo)體分支機(jī)構(gòu) - 正在擴(kuò)展對(duì)TensilicaDPU(數(shù)據(jù)處理器)的應(yīng)用范圍，包括TensilicaXtensa?可定制處理器、用于智能手機(jī)和機(jī)頂盒的音頻和語音處理的HiFi DSP(數(shù)字信號(hào)處理器)，以及用于LTE基站、手持移動(dòng)設(shè)備、其他網(wǎng)絡(luò)基礎(chǔ)設(shè)施和客戶端設(shè)備的ConnX基帶處理器。
- 關(guān)鍵字： Tensilica 華為 DPU
富士通半導(dǎo)體獲海思半導(dǎo)體策略ASIC合作
- 富士通半導(dǎo)體(上海)有限公司于日前宣布其獲得海思半導(dǎo)體策略ASIC合作伙伴榮譽(yù)。富士通的高速IP解決方案和ASIC設(shè)計(jì)服務(wù)，是海思授予其這一榮譽(yù)的關(guān)鍵所在。 由于不斷升級(jí)的處理速度和越來越復(fù)雜的調(diào)制解調(diào)算法，現(xiàn)代通信芯片往往會(huì)集成數(shù)億個(gè)同時(shí)工作的晶體管和超高速的模擬互聯(lián)IP。而在這樣的芯片上，領(lǐng)先工藝所帶來的物理設(shè)計(jì)收斂會(huì)變得越來越困難，片上巨大規(guī)模的數(shù)字電路對(duì)超高速模擬IP的串?dāng)_也變得越來越明顯，如何在很短的設(shè)計(jì)周期內(nèi)去盡可能的定義和優(yōu)化全芯片的低功耗策略，如何協(xié)同考慮封裝設(shè)計(jì)來包容超高的功耗
- 關(guān)鍵字： 富士通 ASIC 半導(dǎo)體
Tensilica將攜智能手機(jī)和家庭娛樂最新創(chuàng)新成果亮相CES 2013
- Tensilica日前宣布將在2013年1月8日至1月13日的2013國際消費(fèi)電子展(CES)上演示采用Tensilica數(shù)據(jù)處理器(DPU)的最新智能手機(jī)、數(shù)字電視以及家庭娛樂系統(tǒng)產(chǎn)品。在這些產(chǎn)品中，Tensilica的DPU成功幫助廠商實(shí)現(xiàn)獨(dú)特產(chǎn)品功能、降低功耗并提升性能，在市場(chǎng)競(jìng)爭(zhēng)中脫穎而出。Tensilica展位包括一個(gè)展示區(qū)域以及三個(gè)會(huì)議室，位置在拉斯維加斯會(huì)議中心南廳25060房間。 Tensilica將主要演示其音頻和基帶DSP (數(shù)字信號(hào)處理器)產(chǎn)品，主要參展產(chǎn)品包括： -
- 關(guān)鍵字： Tensilica DPU
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