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賦值語(yǔ)句
賦值語(yǔ)句 文章 最新資訊
Verilog HDL基礎(chǔ)之：賦值語(yǔ)句和塊語(yǔ)句
- 在Verilog HDL語(yǔ)言中，信號(hào)有兩種賦值方式：非阻塞賦值方式和阻塞賦值方式。塊語(yǔ)句通常用來(lái)將兩條或多條語(yǔ)句組合在一起，使其在格式上看更像一條語(yǔ)句。塊語(yǔ)句有兩種：一種是begin_end語(yǔ)句，通常用來(lái)標(biāo)識(shí)順序執(zhí)行的語(yǔ)句，用它來(lái)標(biāo)識(shí)的塊稱為順序塊；另一種是fork_join語(yǔ)句，通常用來(lái)標(biāo)識(shí)并行執(zhí)行的語(yǔ)句。
- 關(guān)鍵字： VerilogHDL 華清遠(yuǎn)見(jiàn) 賦值語(yǔ)句 塊語(yǔ)句 阻塞賦值
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賦值語(yǔ)句介紹
賦值語(yǔ)句 在表述一個(gè)算法時(shí)，經(jīng)常要引入變量，并賦給該變量一個(gè)值。用來(lái)表明賦給某一個(gè)變量一個(gè)具體的確定值的語(yǔ)句叫做賦值語(yǔ)句。在算法語(yǔ)句中，賦值語(yǔ)句是最基本的語(yǔ)句。
賦值語(yǔ)句的一般格式是：變量名＝表達(dá)式 其中"＝"為賦值號(hào)
常見(jiàn)的賦值語(yǔ)句有以下幾種形式：
?。?）a ＝ 3；{賦予變量常數(shù)值}
?。?）b ＝ a ＋ 1；{將含有其它變量的表達(dá)式賦予變量}
?。?）N [ 查看詳細(xì) ]
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