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          流水線操作 文章
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          四種常用FPGA/CPLD設計思想與技巧之流水線操作
          
                                                            
                    
          
                
          
                                
          
                    
          四種常用FPGA/CPLD設計思想與技巧之串并轉換
          
                                                            
                    
          
                
          
                                                

                
          
	                
          
		                	
          
	
          
	共2條
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          流水線操作介紹
          
      			
          
		      	
          
		      			      			      	與哈佛結構相關，DSP芯片廣泛采用流水線以減少指令執(zhí)行時間．從而增強了處理器的處理能力。要執(zhí)行一條DSP指令需要通過取指令、譯碼、取操作數(shù)和執(zhí)行等幾個階段、DSP的流水線是指它的幾個階段在程序執(zhí)行過程中是重疊的，即在執(zhí)行本條指令的同時，下面的3條指令也依次完成了取操作數(shù)、譯碼、取指令的操作。換句話說，在每個指令周期內。4條不同的指令處于激活狀態(tài)．每條指令處于不同的階段。正是利用這種流水線機制、保證		      	[ 查看詳細 ]
		      			      	
          
    		
          
  		
          
  		  		  		  		  		
  		  		        		  		
          
    		
          
      			
          
        			
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