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基于定點(diǎn)DSP處理芯片ADSP2181的語(yǔ)音信號(hào)的識(shí)別
- 基于定點(diǎn)DSP處理芯片ADSP2181的語(yǔ)音信號(hào)的識(shí)別, 近年來(lái)，高性能數(shù)字信號(hào)處理芯片DSP(Digital Signal Process)技術(shù)的迅速發(fā)展，為語(yǔ)音識(shí)別的實(shí)時(shí)實(shí)現(xiàn)提供了可能，其中，AD公司的數(shù)字信號(hào)處理芯片以其良好的性?xún)r(jià)比和代碼的可移植性被廣泛地應(yīng)用于各個(gè)領(lǐng)域。因此，
- 關(guān)鍵字： 語(yǔ)音 信號(hào) 識(shí)別 ADSP2181 芯片 定點(diǎn) DSP 處理 基于
SOPC的運(yùn)動(dòng)視覺(jué)處理系統(tǒng)
- SOPC的運(yùn)動(dòng)視覺(jué)處理系統(tǒng), （1） Nios II嵌入式處理器 Nios II嵌入式處理器是一款通用的 RISC結(jié)構(gòu)的 CPU，它定位于廣泛的嵌入式應(yīng)用。在 Nios II IDE集成開(kāi)發(fā)環(huán)境中，按照操作提示添加、設(shè)置相關(guān)參數(shù)，在幾分鐘之內(nèi)就能生成一個(gè) Nios II嵌入式
- 關(guān)鍵字： 理系 處理 視覺(jué) 運(yùn)動(dòng) SOPC
采用FPGA協(xié)處理的無(wú)線(xiàn)子系統(tǒng)
- 采用FPGA協(xié)處理的無(wú)線(xiàn)子系統(tǒng),子系統(tǒng)劃分選擇方案 FPGA可與DSP處理器一起使用，作為獨(dú)立的預(yù)處理器(有時(shí)是后處理器)器件，或者作為協(xié)處理器。在預(yù)處理架構(gòu)中，F(xiàn)PGA直接位于數(shù)據(jù)通路中負(fù)責(zé)信號(hào)預(yù)處理，預(yù)處理后的信號(hào)可以高效又經(jīng)濟(jì)地移交
- 關(guān)鍵字： 子系統(tǒng) 無(wú)線(xiàn) 處理 FPGA 采用
多冗余輸出的數(shù)據(jù)采集處理單元設(shè)計(jì)與實(shí)現(xiàn)
- 為解決多通道數(shù)據(jù)的遠(yuǎn)程采集和多路冗余輸出問(wèn)題，介紹基于RS 485總線(xiàn)的多冗余數(shù)據(jù)采集處理單元設(shè)計(jì)方法，給出4～20 mA采集模塊、多路冗余輸出處理模塊的設(shè)計(jì)實(shí)現(xiàn)，該單元具有通用性、可擴(kuò)展性強(qiáng)，冗余度高的特點(diǎn)。
- 關(guān)鍵字： 設(shè)計(jì) 實(shí)現(xiàn) 單元 處理 數(shù)據(jù)采集 輸出 功率模塊
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