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“Altera杯”第五屆研究生電子設計競賽在京開賽
- “Altera杯”中國第五屆研究生電子設計競賽今日在清華大學正式拉開序幕。來自中國電子學會的李志武副秘書長，清華大學龔克副校長及Altera公司亞洲區(qū)副總裁李彬先生，教育部、科技部、信息產業(yè)部相關領導和各參賽代表隊師生齊聚一堂出席了在清華大學中央主樓舉行的開幕式。 本屆中國研究生電子設計競賽由中國電子學會主辦，清華大學研究院和Altera公司共同承辦，將分為EDA知識筆試和上機設計兩部分，于8月18日至8月22日在清華大學分階段進行
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良好FPGA信號完整性的實現(xiàn)方法
- 良好FPGA信號完整性的實現(xiàn)方法Signal Integrity of Stratix IIAltera公司 FPGA產品部 高級技術行銷經理 Lalitha Oruganti簡介信號完整性是高速系統(tǒng)設計的關鍵因素。較差的信號完整性會導致工程成本增加，延緩產品發(fā)布，降低產品收益。在當今要求產品能夠及時面市的半導體市場上，忽略信號完整性可能會造成高達幾百萬美金的代價。高速系統(tǒng)中如何保持信號完整性無疑取決于對FPGA的選型。本文闡述Altera Stratix II的基準測試，測試結果表明，Stratix I
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Altera杯 第五屆研究生電子設計開賽在即
- 由中國電子學會主辦、清華大學研究生院承辦的全國性學科比賽——“Altera杯”中國第五屆研究生電子設計競賽（EDA）將于2005年8月17日～22日在清華大學舉行。該競賽是目前中國面向在讀研究生的規(guī)模最大、層次最高的學科競賽之一。截至目前，已經有42所高校和科研院所報名參賽，參賽代表隊將會達到70支。本屆競賽將由中國電子學會秘書長劉汝林擔任組委會主席；中國工程院院士倪光南出任競賽命題和評審委員會主任；以及來自中國人民大學的法學專家擔任競賽監(jiān)督委員會主任。 中國研究生電子設計競賽（EDA）旨在推動中國EDA
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Altera SoPC World研討會展示創(chuàng)新理念
- 市場調查公司Dataquest認為可編程邏輯是整個半導體市場增長最快的部分，到2004年將增長到50多億美元。面對如此巨大的市場，可編程邏輯器件供應商Altera公司不斷致力于技術的創(chuàng)新和市場的擴張。近期該公司在北京舉辦了以可編程單片系統(tǒng)為主題SoPC World研討會，此次活動吸引了眾多本地工程技術人員以及高校師生參加，與會人員對演講內容及Altera公司合作伙伴的現(xiàn)場演示表現(xiàn)出了極大的興趣。研討會上，Altera公司產品規(guī)劃副總裁Robert Blake先生做了“通過創(chuàng)新保持領先”為主題的演講。他表示
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Altera推出Nios II系列軟核處理器
- 前不久，Altera 正式推出了Nios II系列32位RSIC嵌入式處理器。Nios II系列軟核處理器是Altera的第二代FPGA嵌入式處理器，其性能超過200DMIPS，在Altera FPGA中實現(xiàn)僅需35美分。Altera的Stratix 、Stratix GX、 Stratix II和 Cyclone系列FPGA全面支持Nios II處理器，以后推出的FPGA器件也將支持Nios II。自Altera于2000年推出第一代16位Nios處理器以來，已經交付了13000多套Nios開發(fā)套件，N
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Altera以MaxII CPLD全力拓展新市場
- 近年來，通信、計算機存儲器市場的發(fā)展趨勢不容樂觀，而工業(yè)和消費類電子產品則呈上升態(tài)勢，后者有更佳的表現(xiàn)。CMOS數字邏輯產品方面，每邏輯單元價格每年降低25%~35%。用戶們正在尋求小型及缺乏靈活性的ASIC和ASSP的替代產品，這對CPLD來講，是個很好的發(fā)展機會。MaxII器件是Altera新開發(fā)的CPLD系列，與原有Max相比，成本降低了50%，功耗降低了90%，同時保持了Max系列的即用性、單芯片、非易失性和易用性。“Altera的設計師條用新的查找表結構(LUT)，而放棄了傳統(tǒng)的宏單元體系?；?/li>
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摩托羅拉高清晰度衛(wèi)星接收器采用Altera Cyclone FPGA
- Altera公司宣布，摩托羅拉的寬帶通信部門已經選擇Altera Cyclone FPGA用于最新的摩托羅拉DSR500系列高清晰度衛(wèi)星接收器。該FPGA在 DSR500 系列產品中執(zhí)行鏈接高級解碼器和處理器的線路，管理來自前端衛(wèi)星調諧器和解調器的帶寬等重要功能。
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Altera全面供應整系列MAX II CPLD產品
- Altera公司今天宣布即可發(fā)售EPM2210器件，該器件是MAX® II CPLD系列中容量最大的型號，具有2,210個邏輯單元（LE）。此系列的推出代表了MAX II——業(yè)內成本最低、密度最高、性能最佳的CPLD產品現(xiàn)已在市場上全面供應。工程師現(xiàn)在可以充分利用MAX II系列實現(xiàn)以前CPLD無法完成的復雜控制應用。 國家儀器（NI）工業(yè)控制和測量部經理Brian Mac
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Altera在CCBN上展示實現(xiàn)Video-over-IP的業(yè)內第一個FPGA解決方案
- 在CCBN上，Altera（NASDAQ：ALTR）公司公布業(yè)內第一個基于FPGA的Video-over-IP參考設計。系統(tǒng)設計人員可充分利用Altera低成本Cyclone™ FPGA系列和Nios® II嵌入式處理器的可編程能力和靈活性，在新的Video-over-IP領域，采用該參考設計加速實現(xiàn)其高性價比、低復雜度系統(tǒng)的開發(fā)。該參考設計將在3104-3105展位進行演示。Pro Broadband公司項目經理余志武評論說：“Altera首次面市的Video-over-IP解決方案
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Altera發(fā)售高密度極佳性能FPGA
- Altera公司今天宣布已開始發(fā)售EP2S180器件——Stratix® II FPGA系列中最大和最后一個型號。它比相競爭FPGA多出82％的邏輯單元（LE）——此里程碑確立了Altera在FPGA業(yè)界密度、性能和90nm技術的領先地位。采用第三方認可的基準測試方法，Altera展示了Stratix II FPGA平均比競爭對手同類產品快出39％，使Stratix II系列成為當今市場上最快的FPGA。EP2S180器件的發(fā)售完整展示了Stratix II FPGA系列，整個系列密度分布在15,
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Altera新發(fā)布結構化ASIC方案HardCopyII
- Altera公司今天發(fā)布了下一代結構化ASIC方案——HardCopy® II系列。HardCopy® II器件是業(yè)內最出眾的結構化ASIC，采用了獨特的FPGA前端設計方法，每百萬ASIC邏輯門價格低至15美金。HardCopy® II結構化ASIC構建在新的精細粒度體系結構上，面向低成本設計，使邏輯門密度、性能和低功耗達到了更高的水平，在很多領域內，是ASIC和ASSP的最佳解決方案。HardCopy II器件實現(xiàn)了最大220萬ASIC邏輯門、880萬比特RAM和超過350MH
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Altera公布HardCopy II
- Altera（NASDAQ：ALTR）公司發(fā)布了下一代結構化ASIC方案——HardCopy® II系列。HardCopy® II器件是業(yè)內最出眾的結構化ASIC，采用了獨特的FPGA前端設計方法，每百萬ASIC邏輯門價格低至15美金。HardCopy® II結構化ASIC構建在新的精細粒度體系結構上，面向低成本設計，使邏輯門密度、性能和低功耗達到了更高的水平，在很多領域內，是ASIC和ASSP的最佳解決方案。HardCopy II器件實現(xiàn)了最大220萬ASIC邏輯門、880萬比特
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