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基于多數(shù)決定邏輯門的全加器電路設(shè)計(jì)

作者：時(shí)間：2012-02-19 來源：網(wǎng)絡(luò)

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基于多數(shù)決定邏輯門的全加器電路設(shè)計(jì)

3 結(jié)語(yǔ)
提出一種低功耗的僅用輸入電容和CMOS反向器實(shí)現(xiàn)的一位全加器電路設(shè)計(jì)。該電路僅用了6個(gè)管子，從而達(dá)到降低功耗的目的。較少的管子、工作于極低電源電壓以及短路電流的消除是該全加器3個(gè)主要特征。

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