超高速模數(shù)轉(zhuǎn)換器AD9224及其應(yīng)用
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1（CLK）：時鐘輸入;
2（BIT12）：數(shù)據(jù)輸出最低位LSB;
3～12（BIT11～2）：數(shù)據(jù)輸出;
13（BIT1）：數(shù)據(jù)輸出最高位MSB;
14（OTR）：數(shù)據(jù)溢出標(biāo)志位;
15、26（AVDD）：＋5V模擬電源;
16、25（AVSS）：模擬地;
17（SENSE）：參考選擇;
18（VREF）：輸入?yún)⒖歼x擇;
19（REFCOM）：通用參考（AVSS）;
20、21（CAPT、CAPB）：減噪管腳;
22（CML）：共模方式;
23（VINA）：模擬輸入（同相端）;
24（VINB）：模擬輸入（反相端）。
當(dāng)輸入超出輸入范圍時,OTR位的相應(yīng)輸出結(jié)果如表1所列。
3 典型應(yīng)用
3.1 模擬輸入范圍
AD9224可以在內(nèi)部參考與外部參考方式下采用不同的電路設(shè)計來獲得靈活的模擬輸入范圍。其不同電路連接時的模擬輸入范圍見表2所列。
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