高精度3階delta-sigma調(diào)制器的設(shè)計
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4 結(jié)論
本文提出一個用在ADC中的16位的3階8級量化的三階單環(huán)Delta-sigma調(diào)制器。為了提高電路性能，實現(xiàn)較高的SNR和DR，減少量化噪聲的影響，在設(shè)計NTF時采用前饋方式和局部反饋的結(jié)構(gòu)，并進(jìn)行零點優(yōu)化，通過這些方法優(yōu)化了輸出SNR，提高DR，降低量化噪聲，使得電路對于量化噪聲有較好的敏感度。根據(jù)仿真結(jié)果，這個DSM的峰值SNR可以達(dá)到145dB以上，在3階的系統(tǒng)和128的過采樣率下，達(dá)到相當(dāng)高的SNR，之后用Verilog語言對調(diào)制器各電路模塊進(jìn)行建模與仿真。
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