基于AD6620的數(shù)字下變頻(DDC)的頻率變換器
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AD6620的控制接口分串行輸入和并行輸入兩種。由于使用FPGA做芯片配置邏輯，所以，本文選用較靈活、效率較高的并行數(shù)據(jù)作為配置接口的邏輯輸入。
AD6620內部各個模塊的配置寄存器并不是等位長的。具體各模塊內部配置寄存器的位長見表l所列，而內部寄存器的訪問則必須通過外部接口寄存器來指定地址，并由高位到低位按字節(jié)寫入。
外部接口寄存器的位長是固定的，按000到lll編址總共八個。其中低5位的5個寄存器是數(shù)據(jù)寄存器，可用于放入內部某地址的不定長數(shù)據(jù)。而高兩位的兩個寄存器是地址寄存器，用于存放將要訪問的內部寄存器的目標地址，其中最高位111寄存器又和模式控制寄存器復用，且其最高兩位標識為寫增長和讀增長，具體結構如表2所列。
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