基于DSP離散頻率編碼雷達(dá)信號(hào)的實(shí)現(xiàn)
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3 波形發(fā)生
3．1 芯片簡(jiǎn)介
TMS320F28335(TI)32位浮點(diǎn)數(shù)字信號(hào)處理器(DSP)芯片，擁有工作頻率達(dá)150 MHz的32位DSP內(nèi)核處理器，采用哈佛總線結(jié)構(gòu)。程序讀總線有22根地址線和32根數(shù)據(jù)線，數(shù)據(jù)讀寫總線都是32位。
DAC7724為4通道、12位分辨率、±10 V信號(hào)量程，建立時(shí)間10μs，±15 V供電的D／A轉(zhuǎn)換器。理想的輸入數(shù)字量與輸出模擬量之間的關(guān)系如下：
式中：N為數(shù)字量輸入；VOUT為模擬輸出；VREFL為低參考電壓；VREFH為高參考電壓。
3．2 軟件設(shè)計(jì)
3．2．1 設(shè)計(jì)思路
首先執(zhí)行局部搜索算法，得到頻率編碼序列數(shù)組n[L，N]；然后啟動(dòng)定時(shí)器0，設(shè)置死循環(huán)等待中斷；在中斷服務(wù)子程序中將各時(shí)刻信號(hào)s的幅值送至DAC輸出。
3．2．2 設(shè)計(jì)流程
中斷服務(wù)子程序中可通過(guò)撥碼開(kāi)關(guān)控制波形頻率個(gè)數(shù)，即從頻率編碼數(shù)組的N個(gè)頻率中選取1個(gè)，2個(gè)或全部頻率，以實(shí)現(xiàn)實(shí)時(shí)的單基、雙基、多基間轉(zhuǎn)換。其設(shè)計(jì)流程如圖5所示。本文引用地址：http://yuyingmama.com.cn/article/150894.htm
3．2．3 波形輸出具體實(shí)現(xiàn)說(shuō)明
中斷服務(wù)子程序中的波形輸出比較復(fù)雜，有必要作詳細(xì)說(shuō)明。
(1)確定TIMER0的中斷周期prd_isr；
(2)確定在一個(gè)脈寬tb內(nèi)輸出的點(diǎn)數(shù)num=tb／prd_isr；
(3)當(dāng)中斷次數(shù)countnum時(shí)，波形頻率不變，信號(hào)值如下：
將其值進(jìn)行D／A轉(zhuǎn)換，從第i個(gè)通道輸出，每轉(zhuǎn)換一次count加1；當(dāng)中斷次數(shù)count>num時(shí)，count置零，同時(shí)j加1，轉(zhuǎn)到下一個(gè)頻率。
3．3 結(jié)果波形
N=7時(shí)的多基、雙基、單基結(jié)果波形如圖6～圖8所示。
3．4 結(jié)果分析
圖6～圖8中波形的頻率按照求得的頻率編碼n[i][j](0≤iL，0≤jN)變化，且利用撥碼開(kāi)關(guān)實(shí)現(xiàn)了單、雙、多基間的轉(zhuǎn)換，達(dá)到設(shè)計(jì)要求。
4 結(jié)論
利用Matlab進(jìn)行了局部搜索算法的驗(yàn)證，并給出了仿真結(jié)果，結(jié)果表明解得的離散頻率編碼序列集合具有良好自相關(guān)和互相關(guān)性；然后用DSP實(shí)現(xiàn)波形發(fā)生系統(tǒng)，得到的結(jié)果符合預(yù)期設(shè)計(jì)要求。
本文給出了離散頻率編碼雷達(dá)信號(hào)的實(shí)際產(chǎn)生方法，對(duì)實(shí)際應(yīng)用有較高的借鑒價(jià)值。
評(píng)論