基于DSP／BIOS的數(shù)據(jù)采集系統(tǒng)研制
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3 多線程機制設計
3．1 DSP／BIOS提供的多線程機制
DSP／BIOS支持的線程按優(yōu)先級從高到低可以分為硬件中斷HWI、軟件中斷SWI、任務TSK和后臺線程IDL。HWI就是ISR，優(yōu)先級最高，適合200 kHz觸發(fā)的任務；SWI適合100 ms或者更大周期的觸發(fā)任務；Task不同SWI之處在于它在執(zhí)行過程中能被掛起直到必需資源有效，任務之間可以通過queue，semaphore，mailbox進行信息共享；其他線程不運行時才運行IDL；HWI和SWI不能掛起和等待。
3．2 功能劃分及任務規(guī)劃
為了優(yōu)化CPU資源，實現(xiàn)各功能的協(xié)調(diào)運作，需要合理劃分功能、規(guī)劃任務。本設計中構建了2個硬件中斷線程HWI、一個周期觸發(fā)線程PRD以及網(wǎng)絡配置任務線程和網(wǎng)絡傳輸任務線程共5個線程。各線程運行調(diào)度狀態(tài)如圖2所示。
3．2．1 硬件中斷線程
硬件中斷線程主要用來處理響應時間要求嚴格的請求，同時它的優(yōu)先級最高，能搶占當前運行的其他線程及時運行。方案中的RS 422通信共5個接收通道，波特率高達614．4 Kb／s，且每個通道的緩沖FIFO只設計了256 B，連續(xù)通信時半滿觸發(fā)的時間為2 ms左右。因此，采用HWI處理RS 422通信數(shù)據(jù)，5個通道共用一個DSP中斷源。另外，設計要求被測28 V信號作為AD采集的開關，即28 V有效時啟動采集，28 V無效就得中斷當前采集任務。因此，通過比較電路將28 V轉(zhuǎn)換為控制信號觸發(fā)DSP中斷。本文引用地址：http://yuyingmama.com.cn/article/148133.htm
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