孔徑延遲的重要性有許多原因，主要是由于時鐘和模擬信號具有某種形式的同步，而且與其他信號的關系也很重要。在同步信號時，意外的時間延遲會導致數字和模擬信號不能按預期再現，如以下兩個應用所示。

　　在第一個示例中，以兩種不同時鐘對瞬態(tài)事件進行采樣，并比較所得結果。一組樣本中，信號是在預期時間上采樣。另一組中，采樣提早半個時鐘周期，即AD是時鐘周期的-0.5。雖然信號得以精確采樣，可以看到，當樣本彼此堆疊時，得到的數字信號不同。在ADC應用中這可能很重要，容許時序誤差與模擬輸入的最大壓擺率及容許誤差相關，如以下公式所示： 

　　試舉一例，考慮2.048V范圍的8位ADC，將同步瞬態(tài)事件與63 V/μs的最大壓擺率進行數字轉換。如果所需精度為1 LSB (0.008 mV)，則孔徑延遲必須小于127 ps!

　　圖2眼圖顯示的是孔徑延遲的另一示例。眼圖在通信信號內產生，通常與復雜波形相關(例如假想信號I和Q)。其目的是對開放程度最大的眼部中心內的眼圖進行取樣。如果采樣過早或過遲，眼部部分閉合且采樣信號較小，出現誤差的概率較高。大多數通信系統(tǒng)能夠對系統(tǒng)重新定時，確保實現最佳采樣，但必須具有足夠的余量來涵蓋信號鏈內的預計延遲。

　　除轉換器AD外，其他考慮因素包含PCB(印制電路板)材料和時鐘布局。典型PCB布局可能以每英寸150~200 ps的延遲傳播時鐘信號(假定使用標準FR4材料和50Ω走線)。因此，即使是小型PCB走線，也可增加預期時鐘延遲。如果孔徑延遲對您的應用很重要，則應注意讓時鐘長度彼此匹配，并確保時鐘和模擬長度也彼此匹配。設計恰當的布局應提供長度和幾何形狀均匹配的走線長度，同時小心避免大角度和不必要的過孔。當路由模擬和時鐘信號時，通常這些線路具有最高優(yōu)先級，首先接受路由放置。遵循該原則可獲得最佳性能。有關路由模擬和時鐘信號的細節(jié)在指導手冊布局段落中詳細論述。

　　頻域

　　大多數系統(tǒng)對所使用的各種頻率有精度要求。這些要求也適用于類似ADC和DAC這樣的采樣系統(tǒng)。如果提供給這些系統(tǒng)的采樣時鐘有頻率錯誤，則會轉化成轉換后信號的頻率(及時間)誤差。例如，如果DAC額定具有500 MSPS時鐘，產生100 MHz模擬輸出，則時鐘頻率內的任何誤差將直接轉化成輸出頻率誤差。如果采樣時鐘關閉100 ppm(百萬分率)，則所得模擬輸出也會關閉100 ppm。因此在使用數據轉換器時，所選擇的時鐘精度必須匹配DAC的所得模擬輸出或ADC的模擬輸入。

　　相位域

　　時鐘內的靜態(tài)相位誤差會呈現與上述孔徑延遲相同的誤差。但在對信號相位信息敏感的應用中，這一點變得很重要。由于固定時間延遲在不同頻率下產生不同相位誤差，在相位域內，寬帶信號將在整個頻譜上呈現線性相移。在相位內包含大多數信息的應用中，例如視頻和通信，必須考慮這一由時間延遲引起的相移。許多系統(tǒng)中，目標信號可分散在5 MHz或更高頻率上。某一路徑上的延遲會在整個頻譜上引入頻率相關相位延遲。

　　幸運的是，該延遲是線性相位延遲，可以用多種方式進行校正。不過，必須了解時鐘或模擬路徑內的延遲是如何導致額外相位變化的。時鐘和模擬路徑之間的差分延遲會隨頻率變化產生相位誤差，計算公式如下：

　　如上所示，這是與頻率成函數關系的線性延遲。通常，線性相位延遲無需擔心，除非有多條路徑正在進行匹配，如相控陣或MIMO(多輸入多輸出)系統(tǒng)。即便如此，只要路徑間的誤差相互匹配，也不會造成問題。當延遲以非線性方式隨頻率變化時，問題就出現了。群延遲是衡量不同頻率的信號在給定路徑中的傳播速率的指標。由于延遲變化，相移不同于線性相位，難以進行校正。群延遲通常更多地與濾波器路徑而不是系統(tǒng)時鐘相關，因此不在本文討論范圍之內。